FPGA 开发圈 | FPGA 社区

高速连接器发展趋势与质量检验重点

概况在通讯产业蓬勃发展之下，各式电子产品持续追求更佳的传输质量与及时性并提供多元化应用，这些需求促使讯号传递速度持续朝高速发展。为了提升讯号传递速度以及缩短用户的等待时间，除改变讯号编码方式外，降低讯号位准（signal level）亦或是提供全双功的传输模式都成为改良的手段；为达到此一目标，各组件或装置之间对于减少讯号衰减与失真以及避免噪声干扰的要求大幅提升。因此，... 阅读详情

2018-08-02 | Type-C, USB-C, 高速连接器

充分发挥 Python 的威力：用最简单的方法打造互联互通的智能产品

作者：赛灵思工业物联网战略部 Chetan Khona 智能互联产品背后的心理学如果采用适当的质疑心理去思考为什么现在所有东西都套上了只能互联的噱头，你也许就会进一步想到：“它们真的都需要互联互通吗？”比如说蓝牙电动牙刷搭配的手机 app，我至今都没有使用过这类技术和工具，但一样每天早晚把牙刷的干干净净。所以真正的答案在于“人的心理”，而不在于“科技本身”。至少对我来说是这样的（... 阅读详情

2018-08-02 | python, 今日头条

MATLAB数组元素引用的三种方法

1. Matlab中数组元素引用有三种方法：下标法(subscripts) 索引法(index) 布尔法(Boolean) 注意：在使用这三种方法之前，大家头脑一定要清晰的记住，Matlab中数组元素是按列存储(与Fortran一样)，比如说下面的二维数组： A= 8 1 6 3 5 7 4 9 2

2018-08-02 | Matlab

本篇文章目的是使用Block Memory进行PS和PL的数据交互或者数据共享，通过zynq PS端的Master GP0端口向BRAM写数据，然后再通过PS端的Mater GP1把数据读出来，将结果打印输出到串口终端显示。涉及到AXI BRAM Controller 和 Block Memery Generator等IP的使用。本系列文章尽可能的让每一个实验都相对独立，过程尽可能保证完整性... 阅读详情

2018-08-02 | BRAM, Zynq

无以伦比的系统级功耗削减方案

Xilinx 器件可通过精选芯片工艺和功耗架构为所有产品组合实现高电源效率，包括 Spartan-6 系列及 7 系列、UltraScale 以及 UltraScale+ FPGA 和 SoC。对于每一代产品，Xilinx 都不断提升其节电功能，包括工艺改进、架构创新、电压缩放策略以及高级软件优化策略等。以下是特定产品组合功能的详细信息、芯片工艺优势和基准比较。电源估算、热模型、... 阅读详情

2018-08-01 | 电源管理

机器学习中的常见问题——几种梯度下降法

一、梯度下降法在机器学习算法中，对于很多监督学习模型，需要对原始的模型构建损失函数l，接下来便是通过优化算法对损失函数l进行优化，以便寻找到最优的参数θ。在求解机器学习参数θ的优化算法中，使用较多的是基于梯度下降的优化算法(Gradient Descent, GD)。梯度下降法有很多优点，其中，在梯度下降法的求解过程中，只需求解损失函数的一阶导数，计算的代价比较小，... 阅读详情

2018-08-01 | 梯度下降法

学会System Generator（6）——设计优化与导入MATLAB变量

本文是该系列的第6篇。第2篇中以数字滤波器的设计为主题，介绍了System Generator的完整设计流程；第4篇对设计进行了资源分析。本文将在此基础上，讨论如何对设计进行优化，以及介绍System Generator可以导入MATLAB的工作区（workspace）变量的特性。优化设计在第4篇中我们进行了设计的资源分析，结果如下：该设计使用了6个DSP单元，... 阅读详情

2018-08-01 | Matlab, system-generator

ADC详解

ADC ADC是模数转换器转换器的供应商的英文简称，是一种能将模拟信号转变为数字信号的电子元件。通常是将信号采样并保持以后，再进行量化和编码，这两个过程是在转化的同时实现的。 ADC的转换步骤　　模数转换一般要经过采样、保持和量化、编码这几个步骤。在实际电路中，有些过程是合并进行的，如采样和保持，量化和编码在转换过程中是同时实现的。　　采样定理：当采样频率大于模拟信号中最高频率成分的两倍时... 阅读详情

2018-08-01 | ADC, 今日头条, 模数转换器

2018 IEEE最热门47种编程语言发榜！Python雄踞四项第一

今天，IEEE Spectrum发布了最新的第五届年度编程语言交互排行榜！Python不但雄踞第一，在综合指数、用户增速、就业优势和开源语言单项中，全部霸占榜首。人生苦短，你还不用Python吗？今天，IEEE Spectrum发布了最新的第五届年度编程语言交互排行榜！这个榜单综合了9个来源的11个指标，对47种编程语言的流行程度进行排名。当然了，每个程序员都有自己心目中“最好的语言”，... 阅读详情

2018-08-01 | python, 编程语言

基于FPGA的DDR3六通道读写防冲突设计

作者：张凤麒，张延彬，王忠勇；2018年电子技术应用第7期摘要：为了解决期货行情数据加速处理中多个通道同时访问DDR3时出现的数据读写冲突问题，实现了一种基于FPGA的DDR3六通道读写防冲突设计,完成了对单片DDR3内存条的多通道实时访问控制需求。通过ChipScope工具采样结果证明了设计的可行性，提高了并行处理的速度，极大程度地降低了期货行情数据处理中行情计算的时间开销，... 阅读详情

2018-07-31 | DDR3

【视频】在 DSP48E2 Slice 中使用广泛的多路复用器产品反馈

如何在 UltraScale 架构 DSP48E2 slice 中使用最新广泛多路复用器产品反馈功能。本视频将介绍如何使用随 Vivado Design Suite 2016.1 提供的 verilog CMACC 模板实现、复杂乘积累加函数。

2018-07-31 | DSP48E2

学会System Generator（5）Gateway In和Gateway Out详解

本文是该系列的第5篇。第2篇中以数字滤波器的设计为主题，介绍了System Generator的完整设计流程。本文将对其中使用到的Gateway In和Gateway Out模块进行详细介绍。 Simulink到FPGA的转换 Simulink中的仿真模型为连续时间系统，数据格式多种多样；而FPGA中为离散时间系统，数据必须用一定的位数进行量化。两者之间必须要进行从连续到离散的转换、... 阅读详情

2018-07-31 |

异构计算，你准备好了么？

摩尔定律失灵了，已是不争的事实。单纯的提升一种芯片性能变的代价越来越高，与此同时，异构计算成为提高计算力的主流方向。什么是异构计算？异构计算的前景怎么样？ OpenPOWER系统上FPGA异构计算的先进技术又有哪些？为此，小编恶补了一下异构计算的相关知识，并总结出如下几个基本知识点，给大家分享。如有不足，欢迎大家留言补充~ ● 异构计算（Heterogeneous Computing）... 阅读详情

2018-07-31 | 异构计算

学会System Generator（4）资源分析与时序分析

本文是该系列的第4篇，第2篇以数字滤波器的设计为主题，介绍了System Generator的完整设计流程；第3篇介绍了 System Generator导出设计的说明文档和testbench的特性。本文将介绍System Generator对设计进行资源分析和时序分析的相关方法。查看分析结果本文在第2篇设计的数字滤波器模型基础上运行分析。System... 阅读详情

2018-07-30 |

按小时计费的 Vivado 许可证来了！

重磅消息今天我们非常高兴宣布，Plunify 将与赛灵思在 Plunify Cloud 云平台上，合作推出按需供应的 Vivado 设计套装 HLx 版本软件的许可证！Plunify Cloud 云平台构建在世界上最大的云供应商 – 亚马逊网络服务 (Amazon Web Services)。此次Plunify 和赛灵思的全新合作，会给您带来哪些全新云端体验呢？

2018-07-30 | Vivado