PCIe 8.0 | FPGA 开发圈

PCIe 8.0 草案发布：带宽突破 1TB/s，AI 与数据中心的底层引擎来了

judy 在周一, 09/22/2025 - 09:43 提交

9 月 20 日，PCI 特别兴趣小组（PCI-SIG）正式公布 PCIe 8.0 的 0.3 草案规范。这意味着继 PCIe 7.0 完成之后，下一代高速互连标准的研发已全面提上日程。

judy 在周三, 08/06/2025 - 10:41 提交

通过x16通道配置，PCIe 8.0的双向带宽将达到1 TB/s，为高带宽计算场景带来前所未有的性能空间

judy 在周四, 06/12/2025 - 09:48 提交

PCI-SIG今日宣布向会员正式发布PCI Express ( PCIe ) 7.0规范，该规范速度达到128.0 GT/s。PCIe 7.0规范面向数据驱动型应用

很多客户希望在PL里把GMII接口转换为RGMII接口，这就会用到gmii2rgmii converter IP。经常看到客户在使用这个IP的过程中遇到一些问题，本文给出了基于KR260 starter kit板卡应用gmii2rgmii的范例。

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本文主要描述Zynq UltraScale+ MPSoC中APU多个A53,怎么设置成AMP非对称处理模式，让整个系统既能满足性能要求,也能满足实时性要求。

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这篇博客是在上一篇博客 Vitis HLS 系列 1 的基础上撰写的，但使用的是 Vitis Unified IDE，而不是之前传统版本的 Vitis HLS。

AMD QDMA Subsystem for PCI Express（ PCIe® ）旨在利用多队列的概念实现高性能 DMA，以搭配 PCI Express® Integrated Block 一起使用

RFDC这个IP，是RFSoC系列中ADC、DAC的核心。这个IP和PL的资源有互联通道，和ARM相对是独立的。

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