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卫星正在变成“太空服务器”：FPGA为何成为商业航天新底座？
工业视频应用进入“超高速时代”：100Gbps背后意味着什么？
中科亿海微推高集成SoC：国产FPGA开始进入“系统时代”
FPGA DDR3 时序报错全排查，3 个坑 90% 的工程师都踩过
做过 DDR3 的人基本都有一个共识：这东西不是“写出来”的，是“磨出来”的。下面这几个坑，我自己和身边不少人都反复踩过，说不上理论多深，但很“真实”。
2026-06-05 |
时序约束
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DDR3
,
今日头条
卫星正在变成“太空服务器”：FPGA为何成为商业航天新底座？
从卫星通信到在轨AI，Andromeda XZU65正以FPGA可重构能力推动商业航天迈向智能化时代。
2026-06-05 |
瑞苏盈科
,
Andromeda-XZU65
,
商业航天
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首页推荐
突破传统中端局限：Agilex® 5 的破局之策
Agilex® 5 完美覆盖了中端市场的各类需求，无论是受功耗和尺寸限制的嵌入式系统，还是对数据吞吐要求更严苛的密集型应用，它都能轻松驾驭。
2026-06-05 |
Agilex-5
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Altera
COMPUTEX 2026回顾｜探索低功耗FPGA如何赋能下一代基础设施
本次展会期间，莱迪思重点展示了多项现场演示，涵盖安全管理、连接能力、安全防护以及机架级控制等应用场景。
2026-06-05 |
莱迪思
,
FPGA芯片
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COMPUTEX 2026
赋能AI人才培养，紫光同创亮相第二届FPGA教育大会
紫光同创作为国产FPGA核心企业受邀参会，并发表《AI时代，高校产教融合新探索》主题演讲，深度剖析AI时代高等电子信息教育改革与产业人才培育新路径
2026-06-04 |
紫光同创
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国产FPGA
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第二届FPGA教育大会
AMD 锐龙嵌入式处理器驱动助力研华自动光学检测系统
随着工业应用日趋精密与复杂，其制造过程对需要更加强大的处理器。这类应用的其中一个示例便是高精度自动光学检测（ AOI ）系统。
2026-06-04 |
自动光学检测
,
AIMB-723
,
边缘 AI
莱迪思 MachXO5™-NX TDQ FPGA 荣获 2026 Fortress Cybersecurity Award
Lattice MachXO5-NX TDQ FPGA 产品家族在密码学领域的创新实践，展现了网络安全市场的发展方向——通过切实可行的安全技术解决现实挑战，建立信任，并保护关键资产。
2026-06-04 |
莱迪思
,
MachXO5-NX
,
密码学
Far Edge AI 时代，多目标检测为何越来越依赖低功耗 FPGA？
随着 AI 从云端逐步走向边缘侧（Edge），多目标检测（Multi-Object Detection，MOD）正在被越来越多地应用于工业视觉、智能交通、机器人、智慧零售与边缘安防等场景。
2026-06-03 |
AI推理
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莱迪思
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Far-Edge
AMD 发布新款第二代 Versal Prime 系列器件
这些新款自适应 SoC 封装尺寸小至 23 毫米 x 23 毫米，可提供至高 10 万 DMIPS 的标量计算能力，适合于专业音视频、广播、工业物联网等领域的嵌入式应用。
2026-06-03 |
AMD
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Versal Prime
攻克张量网络指数算力瓶颈：微云全息依托 FPGA 落地量子自旋模型硬件加速方案
微云全息提出了一种创新的硬件加速技术，将量子张量网络算法转换为可在现场可编程门阵列（FPGA）上运行的并行计算电路，实现了在经典硬件上的高效量子自旋模型模拟。
2026-06-02 |
微云全息
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FPGA加速
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量子计算
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张量网络
DO-254、DO-178C、ARP4754A：三者到底是什么关系
很多 FPGA 工程师刚接触适航开发时，都会把这三份文件拆开来看：ARP4754A 是系统工程的事；DO-178C 是软件的事；DO-254 是硬件的事；我既然是做 FPGA 的，盯住 DO-254 就够了。
2026-06-02 |
DO-254
,
DO-178C
,
ARP4754A
YunSDR小课堂-Versal Al Engine 开发指南(第100讲)
在FLOW导航器中，确保选择了simple_aie_application组件，然后在AIE SIMULATOR/HARDWARE下点击【Build】
2026-06-01 |
YunSDR
,
Versal Al Engine
基于 ALINX FPGA 开发板实现 USB3.2 高速通信（Z7-P+FL2010）
基于 ALINX FPGA 开发板 与 FL2010 USB3.2 子卡 实现高速数据通信，本教程以 ALINX Z7-P 开发板为例。
2026-06-01 |
ALINX
,
FL2010
,
FPGA开发板
芯华章P2E双模验证平台助力跃昉科技RISC-V芯片研发突破调试瓶颈
基于芯华章P2E双模验证平台Emulator模式的FullVision全波形可见功能与bug稳定复现能力，助力跃昉科技快速定位并解决RISC-V芯片核心设计问题，验证效率明显提升。
2026-06-01 |
芯华章
,
RISC-V芯片
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EDA工具
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FullVision
便携医疗的拐点：FPGA如何撬动超声设备的“无风扇时代”
FPGA正推动便携超声进入“无风扇时代”，医疗影像架构开始被重新定义。
2026-05-29 |
Mercury+MP1
,
便携医疗设备
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PolarFire
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Enclustra
边缘AI变了：AMD为何突然强调“小尺寸FPGA”？
AMD推出小尺寸Versal FPGA，边缘AI竞争开始从“拼算力”转向“拼系统集成效率”。
2026-05-29 |
边缘AI
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Versal Prime
,
AI芯片
信驊科技与莱迪思合作推进新一代数据中心控制架构
信驊科技推出 AST1840 辅助管理芯片（SMC），并整合莱迪思 FPGA 技术，为服务器平台带来更具灵活性与扩展性的控制能力。
2026-05-29 |
信驊科技
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莱迪思
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AI数据中心
如何使用 .mem 文件初始化 ROM 并从 PS-APU 读取内容
本篇博文旨在演示如何使用 .mem 文件来初始化 ROM 并从 PS-APU 读取内容。
2026-05-29 |
XPM
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Vivado
FPGA 原型验证中的内存模型应用：基于 DDR5 的 Linux 系统启动与测试
该模型在实现 DFI 协议到 DDR4 时序转换的同时，模拟了 DDR5 的关键协议行为，解决了原型验证中“连不上”的接入难题。模型中还增加了可观测、可控制的“后门”接口，极大提升了调试效率和验证透明度。
2026-05-28 |
FPGA原型验证
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DDR5
,
思尔芯
YunSDR小课堂-Versal Al Engine 开发指南(第99讲)
打开Vitis IDE，并选择一个工作区；2.在选择界面，选Create Platform Component，或者在File->New Component->Platform。
2026-05-28 |
YunSDR
,
Versal Al Engine
,
威视锐科技
FPGA 在安全 5G 基础设施中的优势 —— 戴尔视角
随着各国部署专用 5G 网络，网络基础设施需在网络边缘同时满足高性能与高安全等级要求。射频单元（RU）作为连接数字网络基础设施与射频频谱的关键组件，安全敏感性尤为突出。
2026-05-28 |
FPGA
,
5G
,
Agilex-7
Vivado Block Design 提示IP升级，如何跳过？
在Vivado Block Design里遇到IP核升级提醒时，如果不想升级，完全可以通过设置“锁定”的方式来跳过它。
2026-05-27 |
Vivado
AMD Versal 自适应 SoC 设计的系统级验证加速渐进式方案
AMD Versal 自适应 SoC 为开发者提供了一种异构计算架构，将可编程逻辑（ PL ）、AI 引擎以及高性能处理系统集成于单一器件之中
2026-05-27 |
Versal
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硬件仿真
,
Vitis
YunSDR小课堂-Versal Al Engine 开发指南(第98讲)
本教程介绍了使用AI引擎和PL内核的裸机主机应用程序的完整端到端流程。本教程基于2025.1 Vitis统一软件平台。
2026-05-27 |
YunSDR
,
Versal Al Engine
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威视锐科技
深度解析智多晶Sealion 2000系列：国产芯片新标杆的硬核实力
为一款低成本、低功耗、即时启动且高可靠性的非易失性可编辑逻辑器件，它兼容主流封装，并提供多样化的容量选择，使其广泛适用于通讯、工业、医疗等多个领域。
2026-05-26 |
智多晶
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Sealion-2000
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国产FPGA
AI加速器：AI算法运算与应用加速引擎
当我们应用AI聊天机器人、AI大模型时，这背后需要足够的算力支撑，本文就来聊聊背后的AI硬件设备的底层逻辑，通过复杂的底层运输展现出强大的应用服务。
2026-05-26 |
AI加速器
,
AI大模型
YunSDR小课堂-零强制均衡器(第97讲)
假设接收机采用以下离散时间模型：其中，wk为白化滤波器的输出信号，fk为白化滤波器的冲激响应，nk为功率谱密度为N0的白化噪声信号。
2026-05-26 |
YunSDR
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零强制均衡器
,
威视锐
AMD FPGA文档如何高效查找？
无论你是 FPGA 入门学习者，还是资深硬件开发工程师，这套官方资源都是进阶路上不可或缺的工具，建议直接收藏，常备用！
2026-05-25 |
FPGA文档
,
AMD-FPGA
Versal Gen2连载第八篇--开普勒KPL3858 MIPI C-PHY接口的介绍和测试
本文介绍了MIPI C-PHY的技术原理及其与D-PHY对比，重点说明了Versal Gen2 X5IO Bank对C-PHY的原生支持机制，包括Octad结构、C-PHY管脚映射规则（BIT0/1/2和BIT4/6/7）以及嵌入式时钟恢复特性。
2026-05-25 |
Versal Gen2
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KPL3858
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MIPI-C-PHY
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每日头条
新左移：以FPGA原型验证为“决策透镜”，加速RISC-V IP精准选型
“新左移”理念的核心，是在芯片设计流程中影响最大、成本最低的早期阶段，就最大限度地识别并降低技术风险。通过将FPGA原型验证前置到架构探索与IP选型阶段
2026-05-25 |
FPGA原型验证
,
RISC-V
GTM 线速率为 106.25 Gb/s 时如何选择激活 DCMAC 偶数通道或奇数通道
本文解释了当 DCMAC 线速率为 106.25 Gb/s 时，如何选择偶数活动通道或奇数活动通道。
2026-05-22 |
DCMAC
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Versal
Agilex® 7 FPGA 面向 AI 与云基础设施实现线性可插拔光模块（LPO）
构建更高效的 AI 与云基础设施，需要细致审视数据通路中每个组件的作用。结合行业分析与近期标准化工作，线性可插拔光模块（LPO）正成为高速互联领域备受关注的核心创新技术。
2026-05-22 |
Agilex-7
,
光模块
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Altera
YunSDR小课堂-MATLAB与Simulink入门(第96讲)
系统对象是MATLAB中类的特化，定义了一组特定的方法，使初始化、运行时操作和资源释放过程更加简便。
2026-05-22 |
YunSDR
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Matlab
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Simulink
原型验证的Debugger：筑牢流片前“最后一道防线”
hsDebugger工具支持最多16片FPGA的并行调试，即同步抓取16片FPGA中的数据，且16片波形数据在同一窗口中显示，对用户完全透明，可把16片当成一个整系统对待，简化用户调试流程。
2026-05-21 |
原型验证
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Debugger
,
亚科鸿禹
西门子硬件辅助验证针对可扩展智能体 AI 完成 Arm AGI CPU 验证
西门子与 Arm 合作，为 Arm® AGI CPU 提供验证支持，并验证其在下一代代理式 AI 工作负载下的性能，助力打造可扩展、可投入生产的基础设施。
2026-05-21 |
西门子
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硬件辅助验证
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AI智能体
YunSDR小课堂-MATLAB与Simulink入门(第95讲)
本节介绍了查找误差的一般方法，以及利用自动代码分析功能检测MATLAB代码中可能的改进点。特别介绍位于编辑器中的MATLAB调试器功能，以及等效的命令窗口调试功能。
2026-05-21 |
YunSDR
,
Matlab
,
Simulink
向 1 GHz 冲刺：Agilex® 7 刷新 FPGA 性能上限
对很多 FPGA 设计人员来说，真正难的从来不是“芯片能不能跑得快”，而是当设计越来越复杂时，系统还能否顺利完成时序收敛。
2026-05-21 |
Agilex-7
,
FPGA设计
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Altera
《我与瑞苏盈科板卡的开发故事》征文活动
诚挚邀请每一位使用过瑞苏盈科开发板的工程师、开发者与合作伙伴，一起记录：那些发生在板卡之上的“真实开发故事”。
2026-05-20 |
瑞苏盈科
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FPGA板卡
,
每日头条
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Enclustra
工业视频应用进入“超高速时代”：100Gbps背后意味着什么？
基于Mercury+ PE3的工业视频平台，正在推动高速视频系统向边缘实时计算演进。
2026-05-20 |
工业视频
,
瑞苏盈科
,
Mercury+ PE3
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首页推荐
AMD Spartan UltraScale+: 值得信赖的 FPGA，关键指标表现优异
AMD Spartan UltraScale+ FPGA 旨在通过一颗器件即能够提供更高性能、更低功耗、更小的占用面积以及现代应用所需的多种外设。
2026-05-20 |
Spartan UltraScale+
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