下载中心 | FPGA 开发圈

MicroBlaze V 处理器嵌入式设计用户指南

本文档涵盖了以下设计进程：嵌入式软件开发：基于硬件平台来创建软件平台，并使用嵌入式 CPU 开发应用代码。还涵盖 XRT 和计算图 API。

2025-09-18 | MicroBlaze-V, 用户指南, 嵌入式设计

Vitis 参考指南（附下载）

AMD 自适应计算文档按一组标准设计进程进行组织，以便帮助您查找当前开发任务相关的内容。您可以在设计中心页面上访问 AMD Versal™ 自适应 SoC 设计进程。

2025-09-05 | Vitis

采用创新封装解决方案应对散热挑战

本白皮书介绍的特定创新是 AMD 无顶盖封装技术，这项可改变市场格局的技术提供卓越的系统级优势。带加强环的无顶盖封装不应与裸片无顶盖封装混淆。

2025-08-20 | Versal, 散热

UltraFast 设计方法时序收敛快捷参考指南

本快捷参考指南提供了以下分步骤流程，用于根据《适用于 FPGA 和 SoC 的 UltraFast 设计方法指南》（ UG949 ）中的建议快速完成时序收敛

2025-08-13 | UltraFAST, 时序收敛, AMD

SEM IP在MPSoC器件上的使用指南

SEM技术通过目标式ECC奇偶校验位注入实现可观测的软错误模拟。该机制在配置存储器帧（CRAM Frame）内精确选择校验位进行可控翻转

2025-08-11 | SEM IP, MPSoC, an安富利

Agilex™ 5 E 系列 FPGA 与 SoC 存储方案助力嵌入式应用实现最高能效

本白皮书将解释不同 DRAM 类型的关键差异化特性，帮助读者为其应用选择最合适的 DRAM；并将这些特性与 Agilex 5 器件的外部内存方案相结合

2025-08-11 | Agilex 5, DRAM, Altera

Agilex™ 3 与 Certus-N2 器件对比：基于 10 个 OpenCores 设计的正面对标性能测试

本文白皮书展示了对全新推出的 Agilex™ 3 FPGA 与 SoC 产品系列进行的严格基准测试方法与性能分析。该系列旨在为成本优化型应用提供高性能、高集成度和高可靠性。

2025-08-04 | Agilex-3, Certus-N2, OpenCores

软件调试器参考指南

本指南内容涵盖了XSDB 命令、XSDB 用例和硬件软件接口（ HSI ）命令。

2025-07-09 | 软件调试器, AMD, XSDB

下载全新 AMD Power Design Manager 2025.1 版

AMD Power Design Manager 2025.1 版（PDM）现已推出——增加了对第二代 AMD Versal™ AI Edge 和第二代 Versal Prime 系列的支持

2025-07-04 | PDM, UltraScale+

Versal 600G DCMAC Subsystem LogiCORE IP 产品指南

2025-05-28 | Versal, AMD, DCMAC

连接 TI AFE7769DEVM 与 Altera Arria 10 FPGA

本用户指南概述了两个评估模块 (EVM) 的硬件和软件设置：德州仪器 (TI) 的 AFE7769DEVM 收发器和 Altera 的 Arria™ 10 现场可编程门控阵列 (FPGA)。

2025-05-13 | AFE7769DEVM, Altera, Arria

QDMA Subsystem for PCI Express v5.0 产品指南

AMD QDMA Subsystem for PCI Express（ PCIe® ）旨在利用多队列的概念实现高性能 DMA，以搭配 PCI Express® Integrated Block 一起使用

2025-05-07 | QDMA, PCI Express v5.0, UltraScale+, 每日头条

耐辐射双相通用® FPGA 电源参考设计

TIDA-010958 是一种面向 AMD® Versal® AI Core XQRVC1902 内核电源轨的耐辐射同步降压电源参考设计。此设计非常适用于 12V 输入操作，可生成 0.8V 的输出电压和最大 80A 的输出电流

2025-04-29 | FPGA, TIDA-010958, Versal, 电源管理

为低功耗 FPGA、处理器和 ASIC 实施启用 LVDS 链路

随着系统设计人员利用新型处理器、FPGA 和 ASSP 技术，实现低功耗和高效 LVDS 链路比以往更加重要

2025-04-28 | FPGA, LVDS, 德州仪器

AI 引擎编程：Kahn 处理网络的演进发展

本白皮书探讨了如何基于 Kahn 处理网络（ KPN ）定义 AI 引擎图形编程模型。KPN 模型有助于实现数据流并行化，进而提高系统的整体性能

2025-04-16 | AI引擎, AMD, Kahn

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很多客户希望在PL里把GMII接口转换为RGMII接口，这就会用到gmii2rgmii converter IP。经常看到客户在使用这个IP的过程中遇到一些问题，本文给出了基于KR260 starter kit板卡应用gmii2rgmii的范例。

FPGA软核生态全景对比：六大厂商工具解析与产业选型建议

本文将深度剖析当前六大主流FPGA厂商的软核开发工具及软核实现，帮助从业者在选型与应用中做出科学判断。

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Vitis HLS 系列 2：Vivado IP 流程 (Vitis Unified)

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QDMA Subsystem for PCI Express v5.0 产品指南

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使用 Vitis 进行数据中心加速用户指南

本指南的目标是介绍关键概念，并提供一条途径以供您使用基于 FPGA 的 AMD Alveo 加速器卡、 AMD Vitis 编译器和统一集成设计环境来开始应用加速。