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掌握多轴机器人技术:详细步骤指南
智多晶高精度PWM控制方案
五项功能可提升边缘端嵌入式 AI 性能
SA5Z-30 CM3程序下载方法
本文主要阐述对其内嵌CM3核用低价格下载器SWD 进行独立下载,进而达到独立Debug的目的。
2024-05-14 |
SA5Z-30
,
智多晶
,
FPGA
一文搞懂DDR4 MIG IP核详细介绍与配置
DDR4 SDRAM因其高速、大容量的特点,在FPGA设计中扮演着越来越重要的角色。本文将详细介绍DDR4 MIG IP核及其配置过程。
2024-05-14 |
DDR4
,
MIG
,
IP核
FPGA入门基础之按键消抖实验
本文介绍如何在FPGA中实现按键消抖处理。
2024-05-14 |
FPGA
,
按键消抖
Napatech IPU解决方案助力优化数据中心存储工作负载
这篇解决方案简介介绍了Napatech的集成式软硬件解决方案如何将存储工作负载从主机CPU卸载到IPU,同时在应用级别保持完整的软件兼容性。
2024-05-13 |
Napatech
,
SmartNIC
,
IPU
,
数据中心
如何在服务器上调试本地FPGA板卡
联合开发或者跑多策略工程的时候,一般都使用多核的服务器进行FPGA设计。这个时候如果板卡在本地电脑上应该怎么进行调试呢?
2024-05-13 |
服务器
,
FPGA板卡
贸泽电子开售英特尔新成立的独立运营FPGA公司Altera的产品
Altera持续拓展的产品阵容和路线图不仅能满足云、网络和边缘FPGA市场不断增长的需求,还可以增强表现出色的Quartus Prime软件和易于集成的AI功能
2024-05-13 |
贸泽电子
,
FPGA
,
Altera
,
英特尔
第四代AMD EPYC 97X4处理器 为云原生工作负载提供优秀的吞吐量性能
EPYC 97X4处理器拥有系统级线程密度,可满足云原生工作负载增长和基础设施整合所需的可扩展性能要求,并广泛兼容 x86 软件,支持快速、无缝部署的完整服务生态系统
2024-05-13 |
AMD
,
EPYC
,
97X4处理器
莱迪思荣获2024年SEAL可持续产品奖
莱迪思半导体今日宣布其莱迪思Avant™ FPGA平台荣获2024年SEAL奖。
2024-05-11 |
莱迪思
,
SEAL
,
Avant
使用PingPong DMA实时数据采集的参考设计
此教程介绍一种通过双通道DMA,采用PingPong传输的方式,以提高实时数据的处理能力,减小对硬件资源的依赖。
2024-05-11 |
PingPong
,
DMA
,
数据采集
,
每日头图
Vivado Design Suite 用户指南: 设计分析与收敛技巧
本文档涵盖了如何驱动 AMD Vivado™ Design Suite 来分析和改善您的设计
2024-05-11 |
UG906
,
Vivado
,
收敛技巧
,
每日头条
一文快速掌握Vivado下使用Modelsim(测试源码可下载)
通过阅读本文,可以快速掌握Modelsim的常用调试操作。
2024-05-11 |
Vivado
,
Modelsim
AMD Versal™ Adaptive SoC CPM PCIE PIO EP 设计 CED 示例
本文可让开发者们看懂 AMD Vivado™ Design Tool 2023.2 中的“AMD Versal™ Adaptive SoC CPM PCIE PIO EP 设计”CED 示例。
2024-05-10 |
Versal
,
CED
,
PIO设计
,
每日头条
Vivado编译常见错误合集(一)
本文对Vivado编译时常见的错误或者关键警告做一些梳理汇总,便于日后归纳总结。
2024-05-10 |
Vivado
,
编译
AMD 以太网设计示例
AMD 提供了支持不同速度的多种以太网 IP。此外,还提供了设计示例供用户用作参考。请参阅以下以太网设计示例列表。
2024-05-10 |
AMD
,
以太网设计
,
每日头条
1分钟了解常用的AXI4 接口协议
AXI4协议广泛应用于FPGA和ASIC设计中,特别是在需要高速数据传输和复杂系统架构的场合,比如DDR、PCIE、音视频处理IP等等,对于FPGA开发者需要熟练掌握这套协议。
2024-05-10 |
AXI4接口
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FPGA
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