Altera

Agilex® 7 FPGA 与 SoC 搭载符合全新 LPO 100G 标准的高速收发器 I/O，同时集成 400G MAC/PCS/FEC 和 PCIe 等硬核 IP，无需在 FPGA 架构软逻辑中开发定制 HDL 代码，可有效提升设计人员开发效率。

对很多 FPGA 设计人员来说，真正难的从来不是“芯片能不能跑得快”，而是当设计越来越复杂时，系统还能否顺利完成时序收敛。

Altera 正式推出了 FPGA AI 套件 2026.1.1 版本，并带来了全新的空间编译模式。该模式能够为特定模型生成专用的 RTL，让 AI 推理输入流在专属通道中高效运行。