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利用ZYNQ SOC快速打开算法验证通路(4)——AXI DMA使用解析及环路测试

<strong>一、AXI DMA介绍</strong>

  本篇博文讲述AXI DMA的一些使用总结,硬件IP子系统搭建与SDK C代码封装参考米联客ZYNQ教程。若想让ZYNQ的PS与PL两部分高速数据传输,需要利用PS的HP(高性能)接口通过AXI_DMA完成数据搬移,这正符合PG021 AXI DMA v7.1 LogiCORE IP Product Guide中介绍的AXI DMA的应用场景:The AXI DMA provides high-speed data movement between system memory and an AXI4-Stream-based target IP such as AXI Ethernet.

深度学习最常用到的20个Python库

【导读】Python在解决数据科学任务和挑战方面处于领先地位。而一些方便易用的库则帮助了开发人员高效开发。在这里我们整理了20个在深度学习、数据分析中最常用、最好用的Python库,供大家一起学习。

作者| ActiveWizards
编译|专知
整理|Yingying,李大囧

<strong>核心库与统计</strong>

<strong>NumPy</strong>

我们从科学应用程序库开始说起,NumPy是该领域的主要软件包之一。 它旨在处理大型多维数组和矩阵,并且广泛的高级数学函数和实现的方法集合,使得可以使用这些对象执行各种操作。

学会System Generator(20)——基于LSB算法的数字水印技术

本文是该系列的第20篇。数字水印是一种将标识信息嵌入到载体当中,且不影响载体使用的一种技术,主要分为时域水印嵌入算法(将水印嵌入到时域采样数据中)和变换域水印嵌入算法(先对音频做变换,将水印嵌入到变换域系数中)。本文将介绍一种简单的时域水印嵌入算法——LSB算法。

<strong>LSB算法</strong>

通常数字水印技术有不可感知性的要求,即嵌入数字水印后载体数据发生了变化,但是不会影响到该数据的使用,对使用者而言也不可察觉。

Python程序语法元素分析

程序的格式框架

MPSOC之5——开发流程BOOT.BIN

<font color="#FF8000">作者:liuwanpeng</font>

需要把若干文件打成大包,烧写到flash或者sd卡中,才能启动运行。

1.petalinux打包
petalinux-packet打包时,需要petalinux的工程,限制太死了,不用。

中国异构计算黄金时代或将开启

<font color="#FF8000"> 作者:张汉青;来源:经济参考报</font>
 作为2018世界人工智能大会聚焦技术的全球性论坛之一,全球异构计算高峰论坛9月19日在上海举办,受到了国内外业界的广泛关注。

  相关政府部门官员和专家表示,由于特别适合人工智能和大数据时代处理海量数据的需求,近年来异构计算已经成为数据中心、智能手机、5G、智能驾驶等应用领域的主流芯片架构。伴随其极为迅速的发展,中国异构计算的黄金时代或已临近。

  <strong>异构计算成为提升人工智能新引擎</strong>

  根据专家的解释,所谓“异构计算”,是将不同指令架构的计算单元(如CPU、GPU等)融合在一起、实现高效协同运行的计算技术。

petalinux 2018.2 在ubuntu 16下的安装

我第一次安装petalinux2018.2, 是在 ubuntu18, 因为最新的ubuntu 就是 ubuntu18。 在安装中会报一些错,但能安装完成。配置的时候也会报错。看到论坛提问,说目前petalinux2018.2 只是支持ubuntu16。这样我最后选择了ubuntu16。

我的ubuntu16 是安装在虚拟机里的 vm14。 

1: 下载

下载地址是:

在云端加速FPGA回归项目,只需一个Tcl指令

严谨的软硬件开发都会有一套回归测试。连续的整合,每日自动测试,以及手动执行脚本等等 –—— 这一系列方法可以让开发人员来定义、创建、运行验证环节,从而决定产品的质量、性能和可靠性。

本文将聚焦那些需要多次FPGA设计编译的测试,以及如何缩短周转时间同时保证测试平稳运行。

1. 使用云服务器来加速编译

如果您有多个 FPGA 设计和参数组合,而且编译机器的数量又有限,运行测试编译是十分困难的。您需要手写脚本来自动运行编译,但是随着您添加特征和用例,总会有越来越多的情况需要测试。随着测试数量的增加,很多工程师都说每当测试设计的编译结束的时候,下一轮的回归周期又要开始了。由此可见,这种情况让测试范围很受限制,同时为了发布新产品,周转时间的要求也十分严峻。

一个大龄FPGA工程师的9年人生忠告,你不看看?

我做FPGA开发9年多了,算是一个大龄工程师了。期间接触过一些项目管理和技术支持之类的工作,不知道为什么,脱离研发做这些工作我总觉得不踏实,也许天生就适合死磕技术。

就是不知道继续这么死磕下去会怎么样,曾经也很迷茫,生怕随着年龄的增长,精力比不上年轻人,加班熬夜啥的心有余而力不足,会被逐渐淘汰。迷茫啥的就不细谈了,好在我也想了很多,逐渐想明白了很多,这篇文章,我一定要给做FPGA的兄弟姐妹打打气。

我现在最庆幸是事情就是从进入职场到现在一直是FPGA开发,我感觉,做FPGA开发这行经验也是很重要的,入门简单,想提升会越来越难。做FPGA开发不只是会写写verilog和VHDL代码这么简单,我记得刚学习verilog的时候,光是要搞明白哪些语句可以综合,哪些语句不可以综合,就花费了很长时间。

灵活应变的加速是将人工智能从云端带到边缘的关键

<font color="#FF8000">作者:赛灵思战略市场开发总监 Dale Hitt</font>

<font color="#0000C6"><strong>人工智能新兴应用通过带可配置加速的片上系统器件来满足日益严格的性能和效率需求</font></strong>

Python 语法基础之字符集编码

Python初学者编码实践中经常遇到encode error,decode error,如下:

例1:
UnicodeEncodeError: 'ascii' codec can't encode character u'\u5728' in position 1

例2:
UnicodeDecodeError: 'utf-8' codec can't decode bytes in position 0-1: invalid continuation byte

1、百度的时候,大家都建议在代码文件头加上字符集定义:
# -*- coding: utf-8 -*-

利用ZYNQ SOC快速打开算法验证通路(3)——PS端DMA缓存数据到PS端DDR

 上篇该系列博文中讲述W5500接收到上位机传输的数据,此后需要将数据缓存起来。当数据量较大或者其他数据带宽较高的情况下,片上缓存(OCM)已无法满足需求,这时需要将大量数据保存在外挂的DDR SDRAM中。

人加智能FPGA应用实践-AI快速进化,FPGA将大放异彩

<font color="#0000C6"><strong>导语:“AI芯片”这个新鲜的概念在过去一年间逐渐走过了普及的阶段,越来越被大众所熟知。随着大数据发展和算力的提升,AI芯片正迎来新一轮的爆发期。在一片红海的AI芯片市场中,FPGA凭借自己独特的优势占有了一席之地。甚至有媒体报道称,FPGA是AI芯片的终极未来。</font></strong>

XDF 群英荟萃,众多智能方案蓄势待发

XDF(赛灵思开发者大会)报名仅剩一周时间,座位有限。

如何用Python编写你最喜欢的R函数?

本文介绍了采用创建一个Python脚本,用该脚本模仿R风格的函数的方法来方便地进行统计。

是用R语言还是用Python语言?这是一个旷日持久的争论。在此,我们可以尝试采用折中路线:创建一个Python脚本,用该脚本模仿R风格的函数,来方便地进行统计!

<strong>简介</strong>
用R语言还是用Python语言?这是数据科学和机器学习的一场大的争论。毫无疑问,这两种语言在最近几年都取得了巨大的进展,成为数据科学、预测分析和机器学习的首选编程语言。事实上,在IEEE新近的一篇文章中,Python取代C++成为2018年的顶级编程语言,R已经牢牢地保住了它在前10名中的位置。

【视频】以太网演示 | Xilinx 和 Soc-e

Soc-e 的 Armando Astarloa 使用 HSR / PRP IP 核和 Zynq 演示了以太网冗余演示。
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Vivado使用技巧(18)——仿真功能概述

<strong>仿真功能概述</strong>

仿真FPGA开发中常用的功能,通过给设计注入激励和观察输出结果,验证设计的功能性。Vivado设计套件支持如下仿真工具:Vivado Simulator、Questa、ModelSim、IES、VCS、Rivera-PRO和Active-HDl。

MPSOC之4——petalinux提取源码

petalinux使用太不方便,捆绑的太死板,也不通用,还不如直接用编译器来的简单高效。本文说明从petalinux中提取出源代码的过程,前提是已经petalinux-build完成。

1. uboot
编译结果里没有uboot的源码,可能是编译完了就删除了。
从git上下载吧。
git clone https://github.com/Xilinx/u-boot-xlnx.git

Vivado下的仿真入门

本文通过一个简单的例子,介绍Vivado 下的仿真过程。主要参考了miz702的教程,同时也参考了Xilinx的ug937,  xapp199.。

我的软件平台是Vivado 2015.4, 硬件平台是黑金的AC7010, Zynq 7000, 其实与平台关系不大。

本文分为四部分:工程的建立,测试代码,仿真图形输出,更复杂点的例子。

工程和源码下载链接: 链接:http://pan.baidu.com/s/1gflHSdH 密码:fpi5

1:工程的建立:

基于Zynq-7000的自动化监测系统BSP设计与实现

<font color="#FF8000">作者:宋 凯,高 寒;来源:2018年电子技术应用第9期</font>