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谁来扛起国产高端 FPGA 的大旗?智多晶 SA5T-200 给出了一个回答
【FPGA 工程师专属福利】填问卷赢小米爆款蓝牙音箱!
边缘智能加速落地,AMD Spartan UltraScale+ FPGA正式量产出货!
FPGA设计的几种常用基本时序路径
在高速的同步电路设计中,时序决定了一切,要求所有时序路径都必须在约束限制的时钟周期内,这成为设计人员最大的难题,因此,首先确定和分析基本时序路径有助于设计者快速,准确地计算时序裕量,使系统稳定工作,XILINX公司提倡的几种常用基本路径。
2019-09-17 |
FPGA
,
时序
【视频】Xilinx:加速视频及图像处理
赛灵思视频加速技术研讨会上,讲师”Sean Gardner"作演讲“加速视频及图像处理”。
2019-09-17 |
研讨会
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加速视频
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图像处理
ZYNQ进阶之路2-PL端PWM输出呼吸灯设计
在 ZYNQ进阶之路1 中我们讲解了PL端LED流水灯的工程的建立,编码,综合和下载!本节主题,PL端PWM输出设计,讲解怎么用ZYNQ PL端简单实现2通道PWM波输出,其中工程创建过程以及综合生成bit文件过程不再累述!
2019-09-16 |
PWM
,
Zynq
重温FPGA设计流程七:(纯Verilog实现数字频率计)
软件:Vivado2017.4 板卡:Ego1 型号:xc7a35tcsg324-1
2019-09-16 |
FPGA设计
详解Python拼接字符串的七种方式
忘了在哪看到一位编程大牛调侃,他说程序员每天就做两件事,其中之一就是处理字符串。相信不少同学会有同感。几乎任何一种编程语言,都把字符串列为最基础和不可或缺的数据类型。而拼接字符串是必备的一种技能。今天,我跟大家一起来学习Python拼接字符串的七种方式。
2019-09-16 |
python
Xilinx AI 方案与资源更新一览(二)
接上文:Xilinx AI 方案与资源更新一览(一) 全新成功案例——百度将赛灵思 ZU5 用于 Apollo ACU Advanced,百度在 2019 年 7 月于北京举办的年度 AI 开发者大会上推出用于自动代客泊车 (AVP) 的 Apollo ACU Advanced。
2019-09-16 |
Xilinx
,
AI方案
【视频】高效视频处理与 AI 融合架构
赛灵思视频加速技术研讨会上,讲师”廖玉峰"作演讲“高效视频处理与 AI 融合架构”。
2019-09-12 |
视频处理
,
人工智能
,
研讨会
学会Zynq(24)UART控制器简介
本文简单介绍Zynq中的UART控制器,重点放在编程所需了解的知识。很多功能使用库函数可以快速配置,因此没必要仔细了解每个寄存器是干什么的这种问题,应把精力放在UART的特性、工作原理和可实现功能方面。
2019-09-12 |
Zynq
,
UART
Verilog语言设计增加延时的正确方法
在设计仿真激励文件时,为了满足和外部芯片接口的时序要求,经常会用到延时赋值语句,由于不同的延时赋值语句在仿真过程中行为不同,会产生不同的激励输出,如果不认真区分不同表达式引起的差异,就可能产生错误的激励,无法保证仿真结果的正确,本文就是区分各种延时赋值语句的差异,并给出比较结果。
2019-09-12 |
Verilog
【免费研讨会】 Xilinx 最新 AI 技术和资源分享
时间:2019年9月26日上午10:00 - 11:30,本次研讨会同时适用于 边缘(Edge)和云(Cloud)应用,内容将包含:AI 技术与应用的趋势和挑战;赛灵思 AI 应用和技术的最新进展;与 AI 从业人员的互动探讨。
2019-09-12 |
研讨会
开启 5G NR 海量连接时代,第二代 Xilinx 单芯片射频平台现已量产
第二代 Zynq UltraScale+ RFSoC 器件现已量产!!屡获殊荣的赛灵思 Zynq® UltraScale+™ RFSoC,将高性能数据转换器集成于一个硬件可编程的 SoC 上,是面向 5G 海量 MIMO 的业界唯一自适应单芯片射频平台。第二代器件现已全面量产,可立即支持最新 5G 应用。
2019-09-12 |
5GNR
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Zynq-UltraScale
,
RFSoC
AXI总线协议时序
由于ZYNQ架构和常用接口IP核经常出现 AXI协议,赛灵思的协议手册讲解时序比较分散。所以笔者收藏AXI协议的几种时序,方便编程。
2019-09-11 |
AXI总线
ZYNQ进阶之路1--PL流水灯设计
xilinx ZYNQ-7000系列芯片将处理器的软件可编程能力与FPGA的硬件可编程能力实现了完美结合,有低功耗和低成本等系统优势,可以实现无与伦比的系统性能、灵活性和可扩展性,同时可以加速产品的上市进程。与传统的SoC处理解决方案不同,ZYNQ-7000器件的灵活可编程逻辑能实现优化与差异化功能,使设计人员可以根据大部分应用的要求添加外设和加速器。
2019-09-11 |
Zynq
,
Zynq-7000
FPGA的RTL级几种状态控制的分析总结
外部触发信号到来后,执行若干步骤,步骤由计数器控制。(这里的计数器可计数为0-127)。故触发信号高电平使能计数器使能信号(用组合逻辑实现)。仅计数器记到127后,或者复位信号到来,计数器使能归0.使能一旦归零,计数器恢复0。
2019-09-11 |
FPGA
【视频】Codec 世界的新蓝图
赛灵思视频加速技术研讨会上,讲师”Fabio Murra"作演讲“Codec 世界的新蓝图”。
2019-09-11 |
Codec
,
解码器
,
研讨会
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