Xilinx FPGA DDR3设计（一）DDR3基础扫盲
judy 在 周二, 06/07/2022 - 09:40 提交
本文我们介绍下DDR3的基础知识，涉及DDR3管脚信号、容量计算、重要参数介绍内容
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米联客浅谈Xilinx FPGA BRAM的基本使用
judy 在 周一, 06/06/2022 - 17:03 提交
Xilinx系列FPGA，包含两种RAM：Block RAM和分布式RAM（Distributed RAM），他们的区别在于，Block RAM是内嵌专用的RAM，而Distributed RAM需要消耗珍贵的逻辑资源组成。
使用 CCIX进行高速缓存一致性主机到FPGA接口的评估
judy 在 周一, 06/06/2022 - 10:30 提交
在今年的FCCM会议上，德国TU Darmstadt和Reutlingen University联合发表了一篇CCIX相关的文章，该文章使用CCIX作为FPGA与Host之间的接口，并详细评估了CCIX与PCIe之间的差异
Versal ACAP和ESIstream串行接口
judy 在 周一, 06/06/2022 - 09:49 提交
本视频将介绍基于VCK190开发工具的ESIstream Versal开发包，帮助您熟悉其使用方法并加速您的开发流程。
SoC中IP化设计的考虑因素总结
judy 在 周一, 06/06/2022 - 09:35 提交
本文就针对IP设计中注意事项、有用策略及FPGA原型设计等进行简要说明。
战斗机器人“Switchback”采用了 KRIA SOM，适用于 AI 和视觉系统
judy 在 周四, 06/02/2022 - 16:28 提交
SwitchBack 团队使用 KV260 视觉 AI 入门套件和 Kria™ SOM 来添加 AI 功能和视觉辅助功能，以确定对手机器人并旨在实现前所未有的自主权和准确性水平。
3D封装挑战与机遇
┃ 直播详情 ┃
5月31日,《EDA仿真最新趋势和效率提升》直播圆满开启，约3000人围观了此次直播，这是本次直播的回放，如果有朋友想继续及提问，注册成功后评论提问，我们会转给专家回答，多谢大家的支持，本次直播详情如下：
Xilinx FPGA时钟及I/O接口规划（二）
judy 在 周四, 06/02/2022 - 10:17 提交
Vivado®Design Suite提供了几种可能影响I/O和时钟规划的器件规划功能。例如，FPGA配置方案、约束、配置电压方式都会影响I/O和时钟规划。
2022.1 嵌入式软件工具新增功能
judy 在 周四, 06/02/2022 - 09:59 提交
本视频涵盖了 AMD-Xilinx 2022.1 版嵌入式软件环境中的新增功能和更改。