作者:joy_v
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或许是每个做硬件的厂商都有做软件的心,xilinx发布了他的下一个平台Vitis,也就是硬件和软件分开了(即Vivado和IDE分开了),除了启动方式和使用方法略有区别外,其他操作几乎与上一代Vivado一模一样。本文是试用这个新平台来尝尝鲜。
本来不想使用的,重装系统了,那就重新安装最新版吧,软件安装总共60多G,我的固态硬盘呐!!!!!!!!!心疼3s……
安装完成后出现了三个图标,前俩不多说,最后一个即是xilinx的独立的软件开发平台。
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打开Vitis之后是这样的,相较于以前的IDE似乎没什么的差别
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开始创建工程,这里以黑金的AX7020板子为例,打开Vivado2019.2一步步创建工程,反正就是“Next”,一直到“Finish”
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空的工程创建完毕
添加 Block Design
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添加Arm核
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双击ARM核设置一下,这里设置跟板子一致UART1,波特率选择115200,没有用到PL,AXI也没使用。
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时钟默认即可,黑金的7020最高可以跑到767Mhz。
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设置完成。
自动连一下
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好了,生成文件
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生成顶层文件
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硬件部分完成了。
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导出设计到软件,没有用到PL,所以不用综合生成bit文件了,这里直接导出
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导出完成,这里开始软件操作,先创建一个 platform project导入刚才的设计
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选择Vivado导出的设计,点击 finish完成
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创建一个Application project
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编译helloworld工程
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给板子接好,上电,连接串口软件,我的串口是com3设置如下
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下载运行
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已经输出了“hello world”
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结束
整体来说跟之前没有区别,至于官方宣传Vitis的AI还没研究过,感觉这个平台编译似乎有点慢,也许是塞了很多用不到的功能,用起来要麻烦一点,还要自己导入。