视频

此次“自适应计算挑战赛”面向所有独立开发者和初创企业。比赛要求使用 Vitis / Vitis AI 在 Xilinx 平台上实现算法和应用的硬件加速。获奖者将获得奖金！ 立即注册并开始设计吧！

在此视频中，我们展示了一个 Xilinx 实时视频服务器一体机参考架构，该一体机使用 8 个 Alveo™U50 数据中心加速卡构建。使用此架构，在带有 AMDEPYC® 处理器的 HPE Proliant DL-385 服务器上实现高质量 1080p 实时视频流的实时解码/编码。

欢迎收看本期 Vitis 快速上手视频，我们将重点介绍如何使用 Vitis 在 Alveo 板卡上开发和部署硬件加速应用。Demo 部分会包含 Vitis 图像化界面和命令行流程，并展示如何使用 Xilinx github 加速用例。
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基于新型的赛灵思实时服务器（ Xilinx RT Server）参考架构，两大全新一体机将双管齐下，助力当今服务提供商以每通道最低成本提供视频质量和比特率优化的多种类型应用。本文我们将开始为您揭开这一与众不同的实时转码一体机...

112G PAM4 是业界通向更高带宽的下一步。该演示主要介绍 Xilinx 针对新一代系统提供 112G 的远景。

本视频演示了如何设置主机以在云或嵌入式器件上开发和运行 Vitis AI 开发环境应用。

了解嵌入式软件（如 Linux、Xen Hypervisor 和免费实时操作系统）与构建工具（如 Yocto 和 PetaLinux）在 2020.1 发布周期中的新特性。 该视频将详细介绍在该发布周期中所有的新增功能与修改内容

在本视频中我们将简单介绍 PetaLinux 工具开发与构建环境此环境支持客户构建以赛灵思器件为目标的 Linux 版本，并快速评估赛灵思嵌入式平台。

本次网络研讨会概述了 Zynq UltraScale+ RFSoC 及其在有线电视接入远程 PHY 节点中的应用。我们将首先为世界上唯一集成模数转换器的硬件可编程片上系统提供技术概览，并提供关键性能指标。随后，我们将讨论其在远程 PHY 节点上的应用，该节点利用 Xilinx 合作伙伴 Calian SED 提供的关键 IP 块。

本次网络研讨会描述了两个使用 Zynq UltraScale + RFSoC 进行无线通信的设计示例。 首先，让我们回顾一下针对大规模 MIMO（64x64），100MHz LTE（ORAN 7.2 split）的设计，并解释其实现和选型性能数据。

Xilinx 提供了一个基于命令行的自包含实用程序，称为 xclbinutil。 您可以将其用于 Xilinx 加速器二进制容器文件（.XCLBIN）。本视频将带您了解使用 xbutil 检查、报告并修改 xclbin 内容的基本步骤。
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本视频解读 DFX 布局规划基本信息视频，介绍了扩展布线区域的使用。这项 Vivado 功能面向 UltraScale 和 Ultrascale+ 器件，可改善 DFX 设计结果，设计人员创建其布局规划时应考量如何运用此功能

本视频围绕 UltraScale 和 UltraScale+ 架构，回顾了 DFX 布局规划基本信息；并提供了通过创建更优化的布局规划来改善设计结果的策略和技巧。

各位开发者小伙伴请听题：

请问，Vitis 从入门到实践需要几步？

这个过程比大家想象中简单

答案是：只需四“部”

为什么是四“部”？

答案马上揭晓

赛灵思嵌入式处理产品组合中的赛灵思嵌入式软件堆栈组件简介。
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作为最早采用 Versal ACAP 的企业，Keysight Technologies 展示了如何使用 Versal ACAP AI 引擎来加速 5G 及更高版本的高级分析。
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Xilinx 提供基于命令行的实用工具 xbutil，它可用来与 Xilinx 加速器卡的用户功能进行交互。本视频将带您了解使用 xbutil 检查、报告并验证 Alveo 卡的基本步骤

该演示将指导用户完成使用 Vitis™IDE 创建和执行 Linux 应用程序所涉及的步骤。

简要概述 Yocto Project， 以及如何将其用于构建面向 Xilinx 平台的嵌入式 Linux 发布。
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使用可编程硬件技术来实现完整的发射链，以提高功率放大器的效率，通过可编程硬件技术实现完整的接收链，其中包括数字下变频以及与模拟前端和无线电设备控制器连接的接口。