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把 Vivado 项目放心交给 Git:一篇 FPGA 工程师必读的实战指南

之前分享过一篇文章《FPGA 版本管理三种方式:你会选哪一种?》,评论区很多人都推荐使用Git进行版本管理,今天这篇文章主题就是使用Git进行备份指南。

FINN:FPGA AI 推理新范式 —— 定制化、高性能、量化神经网络编译器框架

FINN 是一个由 Xilinx(现 AMD Research)集成通信与 AI 实验室开源的机器学习框架,它提供了一个端到端的方案,用于探索和实现 量化神经网络(QNN)在 FPGA 上的高效推理加速器

项目开发中常用的Vivado软件调试技巧(一)

在项目中,利用JTAG采样低频数据时,受限于片上BRAM资源,采样的数据深度不能太深;另外,通常会受限于JTAG仿真器时钟也不能设置太低频率

BerkeleyLab Bedrock:为 FPGA 与加速计算打造的开源基石

Bedrock 是由 Lawrence Berkeley National Laboratory多年累积的一套开源 Verilog 代码库,旨在把可移植的数字与射频模块快速带到 FPGA 平台上

将 FIR 滤波器写得更“上游” —— 面向 FPGA 的架构与高性能编码实践

FPGA 非常适合实现像 FIR 滤波器这样的信号处理功能。器件内的 DSP 单元带有内建的乘加(MAC)能力,非常适合这类应用。

基于XADC IP核的FPGA芯片温度读取设计

本文利用VerilogHDL语言,通过Xilinx提供的XDAC IP核实现ZYNC-7000 SOC芯片温度实时读取。

YunSDR小课堂-软件定义无线电概论(第59讲)

随着数字通信系统演变为高度复杂的设备,显然需要采用分而治之的策略,以使这类系统的设计与实现变得可行且易于管理。

FPGA时钟区域如何理解?

理解FPGA时钟区域对于进行高性能、高可靠性FPGA设计至关重要,是FPGA开发中实现“心中有电路”的基本功。

fpga实现音频预加重(pre-emphasis)滤波器

在语音信号中,声门波激励和口鼻辐射效应共同导致语音信号的高频分量能量要比低频分量弱。预加重(Pre-emphasis)的目的就是:

通过 UART 实现远程 AXI 访问:让 FPGA 调试更灵活

接口完全用 RTL 编写,它允许通过 UART 连接,在 AXI 总线上执行读写操作。采用这种方式,可以让 FPGA 串口连接到嵌入式板卡的串口上


相控阵天线主要组件及FPGA应用

简单来说,相控阵天线是一种通过电子方式控制波束方向,而无需物理转动天线的先进天线系统。


不用 JTAG 也能刷 FPGA:TinyFPGA-Bootloader 让比特流加载更简单

在 FPGA 设计中,一个常见但略显繁琐的环节是:如何方便地将新的比特流加载到 FPGA。尤其是在没有专用 USB-JTAG/编程芯片或者在低成本板卡中

为什么越来越多 FPGA 项目开始依赖 MicroBlaze V?深度解析

在各类行业与应用中,经常能看到许多 FPGA 设计。一个非常常见的现象是:设计者常常用复杂的有限状态机(FSM)来实现 I²C、SPI、GPIO 时序控制等功能。

AMD(XILINX)7系列FPGA的时钟资源有哪些?

AMD(Xilinx)7系列FPGA性价比很高,应用非常广泛,今天分享一下它的时钟资源相关知识。

如何评估一个FPGA设计的性能?

评估一个FPGA设计的性能是一个系统性的工作,需要从多个维度和指标进行综合考量。这不仅仅是看“跑得多快”,而是要在速度(时序)、资源、功耗和设计稳健性之间取得平衡。


FPGA开发的四大基本原则是什么?

从软件编程转向FPGA设计,最大的挑战并非语法学习,而是思维模式的根本转变。这里分享下FPGA开发的四大基本原则。


传统FPGA开发流程的9大步骤有哪些?
FPGA 的传统开发流程,通常被称为 “RTL 到比特流” 的设计流程,是 FPGA 开发中最基础、最核心的步骤。整个流程可以分为以下几个主要阶段


实践为实-聊聊Lattice Crosslink-NX器件的功耗数据

今天主要是聊一聊Lattice Crosslink-NX的低功耗情况。不管用得怎么样,熊猫君用过的FPGA按厂家分有Intel(Altera)、AMD(Xilinx)、Lattice、紫光同创、安路、易灵思和高云。

FPGA 玩转 4K 视频输入输出:让图像处理更“丝滑”

在游戏、影视和显示领域,4K 已经成为标配。而今天,我们就来聊聊——如何用 FPGA 实现 4K 视频的输入输出与处理。

隐形布线之王:深入 PathFinder 在 FPGA 中的角色与缺陷

自 1990 年代末以来,PathFinder 一直是 FPGA 布线(routing)阶段的主力算法,为设计工具提供“能连通又不重叠”的路径规划方案。