【下载】Vivado设计套件用户指南：创建和打包自定义 IP (v2020.2)
judy 在 周二, 01/26/2021 - 14:45 提交
本文描述了在 Vivado® Design Suite 中创建、打包和重用自定义 IP 的过程。详细介绍了如何使用创建和包装 IP 向导来包装自定义 IP，包括 IP 集成器中开发的 IP 和高级 IP 包装选项。
All node
【视频】高层次综合：从 C 语言到硬件创建
judy 在 周二, 01/26/2021 - 09:53 提交
本视频将介绍Vitis HLS产品以及支持从基于C语言开始对FPGA进行编程的底层技术。
【ZYNQ Ultrascale+ MPSOC FPGA教程】第二十二章 PS端I2C的使用
judy 在 周二, 01/26/2021 - 09:37 提交
PS端I2C的使用
【视频回放】借助硬件光线追踪，实现移动端影视级画质
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开发者分享 | PS IIC 和 AXI IIC 调试技巧
judy 在 周一, 01/25/2021 - 15:39 提交
“IIC 协议与编程序列” 一文，我们为内部集成电路 (IIC) 协议的初学者们提供了有关该协议基础知识和编程序列的详细解释。在本篇博文中，我们将探讨有关 AXI IIC 和 PS IIC 的自调试技巧。
TVM学习（六）细读前端
judy 在 周一, 01/25/2021 - 11:29 提交
用了几章的篇幅写了一些粗读TVM代码的收获，虽然读了一点皮毛，但是还是掌握了TVM的基本架构和代码组成，算是给以后的精读打下了一点基础吧。从这章开始再从头捋一遍TVM代码，顺序是frontend-build-optimize-lower-target
【视频】Versal 的 AI 引擎开发简介
judy 在 周一, 01/25/2021 - 09:44 提交
Versal 的 AI 引擎开发简介
Vivado中增量编译与设计锁定
judy 在 周一, 01/25/2021 - 09:10 提交
所谓增量实现，更严格地讲是增量布局和增量布线。它是在设计改动较小的情形下参考原始设计的布局、布线结果，将其中未改动的模块、引脚和网线等直接复用，而对发生改变的部分重新布局、布线。这样做的好处是显而易见的，即节省运行时间，能提高再次布局、布线结果的可预测性，并有助于时序收敛。
【下载】用于 PCI Express v2.1 的 Versal ACAP CPM 模式产品指南 (v2.1)
judy 在 周五, 01/22/2021 - 17:56 提交
本指南描述了配置为 PCI Express® 功能模式的 CPM 模块。
【ZYNQ Ultrascale+ MPSOC FPGA教程】第二十一章 PS端UART读写控制
judy 在 周五, 01/22/2021 - 11:02 提交
在前面的实验中，大家或多或少会发现有打印信息的情况，主要是调用”xil_printf”或”printf”，但是通过什么打印信息呢？我们还记得打印信息之前设置了串口，是的，确实是串口，但这些函数是如何调用串口呢？其实我们可以在”xil_printf”函数定义中看到，注意outbyte函数就是调用UART打印的