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Vivado2020.1 Vitis

vivado2020.1的SDK是不是找不到了?对的,他已经摇身一变,集成进入了vitis,那么他如何使用?以及常见的问题?我们汇总一下:

人工智能引发能源问题,我们该怎么办?(三)

在本系列的前几篇文章中 ,我们讨论了 Dennard Scaling 和摩尔定律的细目以及对专用和适应性加速器的需求。 然后,我们深入研究了功耗问题,并讨论了网络压缩的高级优势。在这第三篇文章中,我们将探讨专门构建的“计算有效”神经网络模型的优点和挑战。

Teledyne SP Devices宣布推出持续数据传输速率为7 GB/s的12位数字化仪

ADQ32双通道12位数字转换器支持每通道2.5 Gb/s的同步采样,而ADQ33则支持每通道1 GS/s的同步采样,并具有开放的Xilinx Kintex Ultrascale KU040现场可编程门阵列(FPGA) 。这两款数字化仪为高容量应用而优化

【下载】Zynq UltraScale+设备中用于PL隔离的内存和外设保护单元应用说明(v1.0)

该应用说明为基于AXI的嵌入式设计提供了PL和PS安全和隔离的桥梁。

汽车电子专场剧透:解构域控制器的个中乾坤

许多情况下,这些域控制器不仅仅是为一款车而设计,而是为一个支持多款车的平台而设计。主控制器可能具有相当长的生产命周期,而在此期间,软件无疑会更新。因此,它既是域控制器的寿命,也是单个车型的寿命,在某种程度上需要有更新的空间。正因为我们不知道将来会发生什么,灵活性才如此重要。

【下载】Xilinx器件上的深度卷积优化白皮书(v1.0)

本白皮书探讨了深度卷积深度学习操作在Xilinx自适应设备上实现。 本白皮书旨在提供针对不同Xilinx器件的多种优化策略,以满足各种任务要求。 在边缘方面,Xilinx实现了轻量级的深度卷积引擎,该引擎支持相应的计算要求。

开发者分享 | 如何给 u-boot 的源码生成 patch 并在 Petalinux 中编译

在软件开发过程中我们经常遇到用 patch 来传递和更新代码的场景。今天赛灵思技术专家以一个端到端的例子来演示在 Petalinux 使用过程中,如何给 u-boot 的源码生成patch 并在 Petalinux 中进行编译。

赛灵思技术日回来了!

3月10日与您相约蓉城, 为您带来赛灵思软件与 AI 方向面对面交流活动!本活动全程免费,名额有限。参会资格以微信审核通知为准,迅速报名吧,干货多多,礼品也多多!

不得不读的 FPGA 设计白皮书——Xilinx FPGA 复位策略白皮书翻译(WP272)

在Xilinx FPGA中实现的设计不需要插入全局复位网络。对于绝大多数设计,所有触发器和RAM的上电后的初始化状态比任何的逻辑复位都要全面,不需要为了仿真而插入复位,因为没有任何东西是未定义的

【工程师分享】在Petalinux编译多个源文件的Linux内核模块,以及扩展Makefile功能

Petalinux可以帮助工程师简化内核模块的创建工作。在petalinux工程目录下,使用命令“petalinux-create -t modules --name --enable”,能创建Linux内核模块,包括c源代码文件、Makefile、Yocto的bb文件。相关文件放在目录“project-spec/meta-user/recipes-modules”,目录结构如下