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瑞苏盈科专栏
我与瑞苏盈科板卡的开发故事
MIPI摄像头工程=7系列FPGA + OV5640(MIPI) + 15 分钟 + VITIS

本文介绍7系列FPGA使用电阻网络实现MIPI电平的例子

基于JESD204B的射频信号高速采集系统设计

本文设计了一种基于JESD204B 的射频信号高速采集系统

如何在Post Synthesis工程中加入 xci文件

当使用第三方综合器比如 Synopsys® Synplify Pro或Mentor® Graphics Precision 来综合

VPX架构的信号处理模块:VPX 6130

VPX 6130是一款与VPX8800配套使用的基带信号处理加速卡,可以通过PCIe X16的方式与主控卡进行通信

基于 FPGA 的低成本、低延时成像系统

本文介绍一下使用FPGA实现低延迟的成像系统

嵌入式5G,在Embedded World上首次亮相

与Patrick Savelli一起看看这项允许在特定情况下部署私人5G网络的技术

Zynq 及 Vitis HLS 助力面向声音合成和声学控制的低时延技术

从音频输入到输出,现有的实时数字音频系统很难实现低于 1ms 的时延

UltraScale 架构系统监控器用户指南

AMD首款 ASIC 级架构,不仅支持数百 Gb 级的系统性能,在全线路速度下支持智能处理

数据中心为什么需要DPU?

在现代数据中心,CPU和GPU是DPU处理器替代工作负载的主要目标

Versal HBM 系列外部参考时钟设计指南

本文旨在呈现 Versal HBM 器件的外部参考时钟电路要求

Vivado中Aurora IP core调用

Aurora 协议是Xilinx公司针对高速传输开发的一种可裁剪的轻量级链路层协议

Versal ACAP 系统监视器架构手册

全新平台管理控制器 (PMC) 中的 Versal SYSMON 在启动时提供快速寄存器访问

降低企业视频基础设施支出 AMD Alveo MA35D颠覆传统架构

抱着手机刷短视频、看各种直播已经成为人们休闲娱乐的主要方式。

AMD Xilinx K26 从eMMC启动Ubuntu

AMD Xilinx K26支持Ubuntu。从ubuntu amd-xilinx下载映像后,把image烧入到TF卡

从FPGA说起的深度学习(七)-循环并行化

在本文中,我们将循环并行化应用于先前任务并行化的推理内核,并平衡层与层之间的执行时间

为 Alveo 卡安装 Xilinx 运行时 (XRT) 需要多长时间?

安装 XRT 需要一分多钟时间,因为它需要时间来编译驱动程序

适用于 SSIT 器件的 Versal Fmax 限制

适用于 SSIT 的 Versal Fmax 取决于时钟拓扑结构扩展范围

双MIPI摄像头图像系统设计

本文展示如何设计一个简单的图像处理应用程序,该应用程序平行处理两个摄像头。

set_input_delay中-add_delay的作用

在设置input_delay时,我们经常会使用下面的方式