如今随着技术的进步，各类嵌入式应用对于架构本身的设计灵活性与功耗性能比提出了更加严苛的要求。瑞萨电子推出了基于Xilinx Zynq-7000的电源时钟管理方案，通过集成了Xilinx基于28nm Artix®-7或Kintex®-7的可编程逻辑，从而实现了出色的功耗性能比与最大的设计灵活性
FPGA 在系统中逐渐由配角变成主角，从普通的胶合逻辑扩展到业务处理，从应用于原型验证扩展到大规模应用于量产设备中。今天的可编程平台已经是最多拥有数百万六输入查找表的强大处理器件
本视频由赛灵思公司 SerDes 系统工程和应用高级总监 Chris Borrelli 向您详细介绍 Versal Premium 系列的技术特性。
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HDL Verifier 能够让开发 FPGA 和 ASIC 设计的设计验证工程师直接从 Simulink 模型生成 UVM 组件和测试平台，并在支持 UVM 的仿真器（比如来自 Synopsys、Cadence 和 Mentor 的仿真器）中使用这些组件和测试平台
今天上午，FPGA发领头羊赛灵思公司以在线发布形式宣布推出 Versal ACAP 产品组合第三大产品系列—— Versal™ Premium，这款FPGA堪称是史上最强大FPGA，它有高度集成且功耗优化的网络硬核，是业界带宽最高、计算密度最高的自适应平台
体验 Xilinx 面向网络与云加速所推出的全球带宽最高、计算密度最高的自适应平台。最新的 Xilinx ACAP 提供了功耗优化网络硬核的突破性集成，可实现最高速、最安全的网络 。Versal™ Premium 系列旨在解决高带宽网络在散热条件和空间受限的环境下运行的挑战，并满足云提供商的计算需求。
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赛灵思今天宣布推出 Versal ACAP 产品组合第三大产品系列—— Versal™ Premium。Versal Premium 系列具备高度集成且功耗优化的网络硬核，是业界带宽最高、计算密度最高的自适应平台。Versal Premium 专为在散热条件和空间受限的环境下运行最高带宽网络，以及那些需要可扩展、灵活应变应用加速的云提供商而设计
EdgeBoard是基于FPGA打造的嵌入式AI解决方案，能够提供强大的算力，并支持定制化模型，适配各种不同的场景，并大幅提高设备的AI推理能力，具有高性能、高通用、易集成等特点
实现了技术方面的突破，那么要如何与生产环境集成呢？如何在实际的业务体系中实现对FPGA优势更好的应用？实际部署是其中最值得探讨与研究的方向。对此，深维科技进行了一系列的探索与尝试，形成了以下几种方案
ZYNQ中包含了两个部分，双核的arm和FPGA。根据XILINX提供的手册，arm模块被称为PS,而FPGA模块被称为PL。ZYNQ内部包含PS和PL两部分，ZYNQ开发有一下四种方式
本篇将讨论MPSoC中IPI的应用。首先澄清这里的IPI不是小伙伴们熟知的Vivado IPI Design Flow的IPI（IP Integrator），而是Inter-Processor Interrupt，是MPSoC中用来在异构多核系统中以中断的形式实现小批量信息交互的结构单元。
当调制方式为16-AQM,64-QAM和256-QAM时需要做位交织，交织的目的是将突发的错误分散开来，把一个较长的突发差错离散成随机差错，再用随机差错的编码(FEC)等信道编码技术消除随机差错，提高通信的可靠性。交织的越深，抗突发错误的能力也越强
在上一篇ZCU106 XRT环境搭建【Xilinx Vitis】中，我参考了XRT中其它平台（ZCU102，ZCU104）的Vivado TCL脚本，同时参考了官方的VCU相关工程，编写了ZCU106 XRT的脚本。在这篇文章中将对该工程进行一下分析。
最近有朋友问，公众号为什么起名叫网络交换FPGA？今天这篇文章就来回答一下。我们将从网络交换的历史讲起，也正如机器学习也赶上了ASIC工艺发展才引起革命性的变化一样。技术发展的历程中，总有那些看似不相关的技术结合起来，结果导致翻天覆地的变化
赛灵思 Alveo™ U50 数据中心加速器卡采用单插槽、小外形尺寸被动散热卡，运行时最大功耗限制为 75W。它支持PCI Express® (PCIe®) Gen3 x16 或双 Gen4 x8，配备 8 GB 高带宽存储器 (HBM2) 和以太网网络功能
对数字信号的比特进行随机处理，减少连0和连1的出现，从而减少码间干扰和抖动，方便接收端的时钟提取；同时又扩展了基带信号频谱，起到加密的效果。为了保证在任何情况下进入传输信道的数据码流中“0”与“1”的概率都能基本相等，传输系统会用一个伪随机序列对输入的传送码流进行扰乱处理，将二进制数字信息做“随机化”处理
