此演示重点介绍了 2018.3 嵌入式软件工具和基础架构的新功能和更新。涵盖的主题包括 PetaLinux 增强功能，Linux 和 U-Boot 更新以及 MicroBlaze 更新
目前赛灵思已向汽车制造商和一级供应商累计供货车级芯片逾1.6亿片，其中5500万片为ADAS芯片，截止2018年赛灵思已经与29个汽车品牌，111款车型展开合作，而赛灵思的在华适配之路才刚开始。
Twitch 使用 Xilinx Ultrascale +™ FPGA 加速和 NGCodec VP9 编码器 IP 进行高清视频压缩和转码，可在不影响直播视频质量的情况下节省 25％ 的比特率。Twitch 在单个 FPGA 上实现了每秒 120 帧，相比 CPU 实现性能提升了 30 倍。
FPGA开源工作室将通过五篇文章来给大家讲解xilinx FPGA 使用mig IP对DDR3的读写控制，旨在让大家更快的学习和应用DDR3。本实验和工程基于Digilent的Arty Artix-35T FPGA开发板完成。
Vivado综合可以理解多种多样的RAM编写方式，将其映射到分布式RAM或块RAM中。两种实现方法在向RAM写入数据时都是采取同步方式，区别在于从RAM读取数据时，分布式RAM采用异步方式，块RAM采用同步方式。使用RAM_STYLE属性可以强制规定使用哪种方法实现RAM。
本来写了一篇关于高速收发器的初步调试方案的介绍，给出一些遇到问题时初步的调试建议。但是发现其中涉及到很多概念。逐一解释会导致文章过于冗长。所以单独写一篇基本概念的介绍，基于Xilinx 7系列的GTX
对于mig与DDR3/DDR2 SDRAM的读写时序我们不需要了解太多，交给mig就可以了。我们需要做的是控制好User Interface，写出正确的User logic。想要写好Userlogic,我们就必须清楚每一个用户控制接口的含义
了解 Vivado System Generator for DSP 2018.3 版本中的全新超级采样率模块集，提供与 MATLAB® 和 Simulink® 集成的设计流程，以加速 Zynq UltraScale + RFSoC 器件上高速 DSP 应用的设计和实现
Gartner预测，到2022年，75%利用人工智能与机器学习技术的新终端用户解决方案将采用商业解决方案而非开源平台构建。商业厂商现在已经在开源生态系统中创建了连接器，为企业提供扩展与推广人工智能及机器学习所需要的功能特性
计算模型的创新带来的是技术的升级换代，而边缘计算的迅速发展也得益于技术的进步。本节总结了推动边缘计算发展的7项核心技术，它们包括网络、隔离技术、体系结构、边缘操作系统、算法执行框架、数据处理平台以及安全和隐私
本视频演示了采用 CCIX 如何实现无缝的 KVS 加速（KVS，Key-Value Storage）。了解如何在不中断客户的应用处理过程的同时实现 KVS 加速，包括使用现有网络推断方案。
<iframe src='https://v.qq.com/txp/iframe/player.html?vid=g0837swy113' allowfullscreen frameborder=0 width="600" height="400"></iframe>
FPGA开源工作室将通过五篇文章来给大家讲解xilinx FPGA 使用mig IP对DDR3的读写控制，旨在让大家更快的学习和应用DDR3。本实验和工程基于Digilent的Arty Artix-35T FPGA开发板完成。软件使用Vivado 2018.1
FPGA开源工作室将通过五篇文章来给大家讲解xilinx FPGA 使用mig IP对DDR3的读写控制，旨在让大家更快的学习和应用DDR3。本实验和工程基于Digilent的Arty Artix-35T FPGA开发板完成。
本视频演示了梅赛德斯-奔驰最新 CLA 轿车在 CES2018 上演示的 MBUX 车内助手，这是一款基于赛灵思技术的全新智能辅助驾驶系统。
