Altera 通过让主流射频平台与其 FPGA 及 Open RAN 参考方案顺畅对接，助力通信服务提供商更快推进 5G-A 部署、提前验证 6G 架构原型，并拓展到卫星、机载连接等新兴非地面网络应用。

第二代 Kintex UltraScale+ FPGA 采用先进连接技术，具有兼容更高带宽的全新存储器接口，同时内置增强的安全功能，可助力打造性能出色且稳定的强大平台

本文介绍在VHK158开发板上，如何使用Versal Soft Memory Controller，替代默认的NoC方案。

在这个示例项目中，使用 AMD Kria™ KV260 Vision AI Starter Kit 结合 TurtleBot3 Waffle 移动机器人平台 来构建一个真实可运行的 ROS 2 系统。

我们将与您深入探讨各类实现方案（滤波架构、数值格式等）及其权衡取舍，确保所有决策均有充分依据，避免项目后期出现遗憾。

在硅谷，几乎每周都有新的AI芯片故事上演。但今天这家刚结束隐身期的公司，讲的故事有点“反直觉”。

针对发射机与接收机之间的符号时序不匹配，存在多种校正方法。然而，在本章节中我们将探讨三种数字。

在现代异构计算架构中，FPGA的可编程逻辑阵列以其高度灵活性著称。但仅靠查找表（LUT）和触发器构成的标准逻辑单元处理复杂算法时

本文结合九大核心理由、成本与良率数据、SRAM 缩放瓶颈及 AI 算力需求爆发背景，解析 Chiplet 如何成为破解先进工艺瓶颈、降低芯片成本、加速 AI 发展的关键力量

7系列FPGA中的时钟缓冲器分为全局时钟缓冲器（Global Clock Buffer）和区域时钟缓冲器（Regional Clock Buffer）。

在本次演示中，我们将展示如何使用 APIO 机制在 Linux 主机上开发该板卡。

本文将以ZCU106开发板为基础，介绍HDMI2.1的硬件和软件实现，并针对常见调试问题给出解决思路。

本文将从稍有不同的角度重新审视该主题，重点关注这些滤波器的实际应用。

公司通过芯片、软件、工具、生产就绪型应用以及不断壮大的合作伙伴生态系统的支持，简化并加速边缘AI系统开发

在实际开发测试中，会出现单通传输正常的情况下多通道传输异常的情况。本文以实际调试时遇到的问题进行总结。

本文将讨论如何使用 Lopper 实用工具为目标处理器生成 DTB。

自动化是现代工业设施的核心支柱，而机器人技术则是推动其发展的催化剂。当下，由人工智能驱动的机器人技术正飞速发展，推动着规模更大、技术更先进的工业部署

中科亿海微凭借在可编程芯片与EDA领域的深厚积淀，成功入选“供应链安全号”首批成员单位。

本文将介绍一款双相降压型稳压器的一些设计思路。这款稳压器的两个通道可以提供总计高达40 A的连续电流，每个通道支持高达30 A的负载

仿真没抓到 CDC， 那工程验证到底该信谁？这一篇，我们把这件事彻底讲清楚。