2020年1月15日，自适应和智能计算的全球领导者赛灵思公司（纳斯达克股票代码：XLNX）在位于北京市朝阳区安定路5号院的中海国际中心新办公室，举行赛灵思北京办公室乔迁庆典，隆重庆祝公司进驻新址。
在数据驱动的人工智能摧枯拉朽般冲击各种应用、衍生无数奇思妙想的今天，赛灵思前沿技术研究与学术合作部门隔空召唤：“Time to Innovation, Time to Paper ” —创新的时候到了，发布学术论文的时候到了！
本教程介绍了如何使用Vivado®集成开发环境（IDE）构建基本的Zynq®-7000SoC处理器和MicroBlaze™处理器设计。在本教程中，您将使用Vivado IP集成器构建处理器设计，然后使用Vitis™统一软件平台和Vivado集成逻辑分析器调试设计。
Video Frame Buffer Read/Write IP 支持您将视频数据从存储器域（AXI4 存储器映射接口）迁移到 AXI4-Stream 接口，或反之亦然。
所谓加扰是将源数据流与一个随机序列异或后，再发送出去，异或操作完成后的数据流基本是伪随机的。PCIE数据发送端有加扰，数据接收端也有解扰操作，解扰与加扰使用相同的公式，必须完全同步，即LFSR使用相同的初始值。
FPGA的用处比我们平时想象的用处更广泛，原因在于其中集成的模块种类更多，而不仅仅是原来的简单逻辑单元（LE）。现在的FPGA不仅包含以前的LE,RAM也更大更快更灵活，管教IOB也更加的复杂，支持的IO类型也更多，而且内部还集成了一些特殊功能单元......
在FPGA中我们写的最大的逻辑是什么？相信对大部分朋友来说应该是计数器，从最初板卡的测试时我们会闪烁LED，到复杂的AXI总线中产生地址或者last等信号，都会用到计数器，使用计数器那必然会用到进位链。
Xilinx统一软件环境应用程序如何使它从最初的硬件设计变为现实？ 在本课程中，我们将介绍与第三方框架，Python API和绑定的集成，用于微服务部署的容器化（包括Docker和Kubernetes）以及其他相关主题。
Python 是一门对初学者友好的编程语言，是一种多用途的、解释性的和面向对象的高级语言。它拥有非常小的程序集，非常易于学习、阅读和维护。其解释器可在Windows、Linux 和 Mac OS 等多种操作系统上使用。它的可移植性和可伸缩性等特性使得它更加容易被运用。
Zynq®UltraScale +™MPSoC验证知识产权（VIP）支持基于Zynq UltraScale + MPSoC的应用程序的功能仿真。 它的目标是通过模仿处理器系统（PS）-PL接口和PS逻辑的OCM / DDR存储器，来实现对可编程逻辑（PL）的功能验证。
自动驾驶技术已成为汽车产业的最新发展方向，应用自动驾驶技术可全面提升汽车驾驶的安全性、舒适性，满足更高层次的市场需求。据市调机构 QYResearch 的预计，到 2023 年国内 ADAS 市场规模将达到 1200 亿元，未来 5 年复合增长率超过 37%。
时间：1月15日 - 17日；地点：日本东京 | 东京国际展览中心（Aomi Exhibition Hall）；事件：赛灵思将现场展示多项汽车解决方案，帮助客户实现从 ADAS 到 AD（自动驾驶）的升级
随着 4G 和即将到来的 5G 时代，互联网上每天都在不断产生大量的图像和视频内容，为了保证网络环境的健康，内容提供商必须对平台产生内容进行严格的检测，避免违规违法内容流入互联网。而随着人工智能（AI）时代的到来，图像智能处理系统开始逐渐替代基础的审核人员。
在 2019 XDF（赛灵思开发者大会）上， Maxeler 公司洪小莹博士为大家现场展示了其基于 Alveo 加速卡的 CVA Calculation (信用风险评估调整)的方案。
大数据时代呼唤算力的革命，未来的“计算”将会是什么样？作为引领下一代自适应 AI 技术的全球领导者，赛灵思如何规划和布局？现在真的是软件开发者的天下了吗？
xilinx FPGA的资源一般指IOB,CLB,BRAM,DCM,DSP五种资源。其中IOB就是input/output block，完成不同电气特性下对输入输出信号的的驱动和匹配要求。
Zynq中断大致可分为三个部分，第一部分为SGI，软件生成的中断，共16个端口；第二部分为PPI，CPU私有外设中断，有5个；第三部分为SPI，共享外设中断，来自于44个PS端的IO外设以及16个PL端的中断。中间部分为GIC，也即中断控制器，用于对中断进行使能、关闭、掩码、设置优先等。
