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FPGA小课堂-使用DDR4控制器实现多通道数据读写（9）本文重点讲如何利用读写DDR4的接口来实现对DDR4的读写控制。

GTY – TX Gearbox的工作机制详解以 64B/66B、4-byte 逻辑接口（每拍输入 2-bit Header + 32-bit TXDATA）为例，TX Gearbox 的输出过程如下

Agilex 5 SoC 的两种启动模式的开发演示（二）（HPS Boot First ）本文将首先介绍这两种启动模式的工作方式，然后在 DE25‑Nano 开发板上完整演示其开发与验证流程。

FPGA小课堂-使用DDR4控制器实现多通道数据读写（8）在之前的章节已经详细介绍了DDR4的AXI协议，并实现了对DDR4简单的读写操作。这一章节来建立单通道的256位数据的读写，并放出工程框架，说明整体设计思路

Agilex 5 SoC 的两种启动模式的开发演示（一）（FPGA Configuration First）本文将首先介绍这两种启动模式的工作方式，然后在 DE25‑Nano 开发板上完整演示其开发与验证流程。

Vitis AI 6.2 入门：在 VEK385 上跑通第一个模型本文是 Vitis AI 6.2 系列的第一篇。目标是在不编写代码、不进行模型量化与编译的前提下，使用发布包中提供的预编译模型，在 VEK385 开发板上完成端到端推理（图像分类与目标检测）

紧凑3D SRAM 器件级堆叠使能关键缩放今天我们来看一种在1纳米工艺节点下目前最紧凑的6T SRAM研究，将CFET堆叠扩展为多层构型，凸显3D器件级堆叠在尺寸缩放的使能潜力。

FPGA小课堂-使用DDR4控制器实现多通道数据读写（7）在上一节中，我们使用DDR4的AXI接口做了一个简单的读写测试，这一节我们使用数据掩码（wstrb）来控制写入数据的有效字节。

为何边缘人工智能需要辅助芯片随着人工智能持续普及，其部署模式正从孤立节点转向覆盖全系统的智能体系，以辅助芯片为核心的主动式设计方案将成为技术持续突破的关键

FPGA小课堂-使用DDR4控制器实现多通道数据读写（6）在上一章节，我们主要概括了AXI4协议的通道结构，VALID和READY的握手机制和传输方式，在这一章节会详细讲解AXI4协议的读写时序内容。

Xilinx RFSoC之MTS介绍及测试AMD XilinxZynq UltraScale+ RFSoC 将高性能 RF-ADC 和 RF-DAC 直接集成到 SoC 内部，用直接射频采样取代了传统的分立数据转换器 + JESD204 接口方案

FPGA小课堂-使用DDR4控制器实现多通道数据读写（3）在上一节中了解了DDR4 IP核的接口信号，这一节主要讲述如何建立DDR4的仿真模型。

FPGA小课堂-使用DDR4控制器实现多通道数据读写（2）DDR4原理图如图2、图3所示。核心模块在PL侧搭载了4片镁光（Micron）的DDR4内存，单片内存大小为1GB，数据接口16bit。

3DIC技术介绍三维集成（3DIC）技术是克服互连缩放瓶颈的极具前景的解决方案。我们一起来了解其发展来的基本构成与特点。

6G原型验证需要回答的四个问题面向6G的原型验证，真正困难的部分并不在于把某个算法跑通，而在于证明实验结论具有可信度。真实无线环境不可控，协议状态与射频链路相互耦合，多通道阵列存在幅相误差

YunSDR小课堂-使用DDR4控制器实现多通道数据读写(第1讲)DDR4是一种高性能存储器标准，用于计算机和服务器的内存模块。与前一代标准DDR3相比，DDR4在带宽、功耗和时钟频率等方面都有所提升

HLS Direct IO的介绍（二）本节结合官方示例 using_axilite_with_directio，说明其与 AXI Lite 搭配的使用方式。

莱迪思带你读懂 | 什么是 MIPI？为什么摄像头离不开它？你有没有想过，手机摄像头拍下的画面，是怎么传输到处理器的？从按下快门到图像出现在屏幕上，数据要在毫秒内完成传输。能做到这件事，靠的是一套叫做 MIPI 的接口标准。