Versal器件Advanced Flow概览
judy 在 周五, 01/10/2025 - 17:10 提交
本文介绍了 Versal 的Advanced Flow，这是 Vivado 2024.2 版本提供的一套新的布局布线功能。
YunSDR通信小课堂(第12讲)
judy 在 周五, 01/10/2025 - 15:10 提交
从时域到频域的转换的简单描述如图3.14所示。离散傅里叶变换（DFT）通常以更有效的形式实现为快速傅里叶变换（FFT）
FPGA实现LVDS接口（1）--IBUFDS原语、OBUFDS原语和IOBUFDS原语的介绍及使用
judy 在 周五, 01/10/2025 - 09:54 提交
IBUFDS原语、OBUFDS原语以及IOBUFDS都是差分信号缓冲器，用于不同电平接口之间的缓冲和转换
如何在 Vivado 中查询 LUTRAM 的 BEL 属性和 LOC 属性？
judy 在 周四, 01/09/2025 - 17:48 提交
几乎所有 AMD 可编程器件都具有 CLB 资源，可以在 LUT 中实现小型存储器。在网表中，这些资源被称为 LUTRAM 或分布式 RAM。
FPGA频率测量的三种方法
judy 在 周四, 01/09/2025 - 17:26 提交
在FPGA中，频率测量是常见的应用，通常用于信号检测、频率计数和时钟管理。以下是三种常见的FPGA频率测量方法
当北京理工大学方程式车队BITFSD遇上瑞苏盈科FPGA核心板
judy 在 周四, 01/09/2025 - 10:11 提交
2025年赛季，北京理工大学路特斯无人驾驶方程式车队（BITFSD）将携手瑞苏盈科，打造无人驾驶方程式车队的“最强外脑”。
YunSDR通信小课堂(第11讲)
judy 在 周四, 01/09/2025 - 09:51 提交
当信号被量化时，在ADC的每个采样时刻获得的幅度值被映射到一组离散的可能幅度电平中的一个。因此，在采样和量化过程的输出端
使用 Vitis 进行嵌入式设计开发用户指南
judy 在 周三, 01/08/2025 - 17:07 提交
AMD Vitis™ 工具套件包含多种设计技术，用于开发以 AMD 器件为目标的异构嵌入式应用。
FPGA+GPU+CPU国产化人工智能平台
judy 在 周三, 01/08/2025 - 15:21 提交
平台采用国产化FPGA+GPU+CPU构建嵌入式多核异构智算终端，可形成FPGA+GPU、FPGA+CPU、CPU+GPU等组合模式
如何编写 RTL 实现时序收敛
judy 在 周三, 01/08/2025 - 09:56 提交
实现时序收敛的关键要素之一是确保我们编写出能够充分利用设备架构特性和实现工具功能的优质代码。让我们来看看可以帮助我们提供更好质量代码的几个方面。