解开电源模块降额曲线的奥秘
judy 在 周二, 08/28/2018 - 10:12 提交
作者：作者：德州仪器 Chris Glaser
随着电子设备的尺寸越来越小，电源设计人员在设计电源时必须考虑热限值的问题。如果一个较小的电源无法在特定的应用环境（包括环境温度）下以高负载运行，那么它就等同于没有用处。
调幅、调频、调相 与 I/Q 调制有什么区别？
judy 在 周二, 08/28/2018 - 09:10 提交
无线通信是现在应用最为广泛的通信技术之一，其核心是把要传输的数据调制在载波上发射出去，载波状态的变化承载了不同的信息。
Xilinx全球副总裁Freddy赴深访问恒扬总部，双方合作将进一步深化
judy 在 周一, 08/27/2018 - 15:05 提交
近日，Xilinx主管全球数据中心业务的副总裁Freddy赴深访问恒扬数据总部，Freddy 一行在CEO李浩等高层的陪同下，对恒扬数据进行了深入调研和参观，双方在愉快的气氛中对以往业务进行了梳理，并达成进一步深化合作意向，双方均对未来合作充满期待。
满足自驾车应用 嵌入式视觉诉求三低要素
judy 在 周一, 08/27/2018 - 14:33 提交
作者：卢佳柔，新通讯 2018 年 9 月号 211 期《 行家出手 》
深入理解阻塞和非阻塞赋值的区别
judy 在 周一, 08/27/2018 - 10:33 提交
阻塞与非阻塞赋值的语言结构是Verilog语言中最难理解的概念之一。
有这样的两个要点：
（1）在描述组合逻辑的always块中用阻塞赋值，则综合成组合逻辑的电路结构；
**（2）在描述时序逻辑的always块中用非阻塞赋值，则综合成时序逻辑的电路结构。
这样做的原因是：**
Zynq-7000 ARM端MIO的使用
judy 在 周一, 08/27/2018 - 10:02 提交
作者：OpenSLee
1. 背景知识
【视频】：Zynq UltraScale+ RFSoC 评估工具演示
judy 在 周一, 08/27/2018 - 09:01 提交
该视频演示了 RFSoC RF 数据转换器评估工具，该工具可对 Zynq UltraScale + RFSoC ADC 和DAC 进行性能评估。
学会System Generator（12）——Black Box及配置文件详解
judy 在 周五, 08/24/2018 - 16:54 提交
本文是该系列的第12篇，上一篇介绍了在System Generator设计中使用Black Box调用HDL代码的方法，并使用Simulink+Vivado Simulator进行了协同仿真。本文将对该block及其中涉及到的MATLAB配置文件作详细介绍。
【视频】Zynq UltraScale+ RFSoC ZCU111 评估套件拆箱
judy 在 周五, 08/24/2018 - 16:53 提交
Zynq UltraScale + ZCU111 评估套件和功能概述。
同步FIFO的设计
judy 在 周五, 08/24/2018 - 16:52 提交
作者：Kevin Zhang
本篇文章整理一下同步FIFO的实现。首先介绍一下FIFO的基础知识：