作者： 范龙飞，文章来源： MYMINIEYE微信公众号
1.ASK信号的调制原理
数字信号对载波信号的振幅调制称为振幅键控，即ASK。
在2ASK调制系统中，数字信息只有0和1两种，所调制的载波信号的幅度变化状态也只有两种：无载波输出时代表发送0；有载波输出时代表发送1。
在4ASK调制系统中，数字信息就有00、01、10、11四种，需要载波信号幅度的4个电平状态表示。...
技术
作者：浙江大学博士生导师王则可博士， 文章转载自：网络交换FPGA微信公众号
本文是第一篇详细介绍HBM在FPGA上性能实测结果的顶会论文（FCCM2020，Shuhai: Benchmarking High Bandwidth Memory on FPGAs），作者是浙江大学王则可博士！感谢王则可博士允许本公众号转载该论文的中文译文。论文给出了FPGA上HBM可提供高达425GB/...
作者：付汉杰，hankf@xilinx.com，文章转载自：博客园
Xilinx的开发板ZCU102支持休眠到内存（suspend-to-ram）。休眠到内存时，DDR进入自刷新，MPSoC被关电，完全不耗电。唤醒时，MPSoC根据外部输入信号判断出不是上电启动而是休眠，就从DDR读出系统状态，恢复系统。
MPSoC启动时，它的DDR控制器会驱动DDR的复位信号，...
文章转载自：PYNQ开源社区微信公众号
本案例来源于第三届全国大学生FPGA创新设计竞赛中江南大学的OpenHEC lab团队，他们的作品基于PYNQ开源软件框架。PYNQ框架提供了完整的访问FPGA资源的Python library，通过高层次的封装，让开发者通过Python API就可以轻松调用FPGA内的模块或算法，加速产品开发部署。
由于篇幅有限，...
本文转载自： XILINX技术社区微信公众号
EFuse 具备一次性可编程特性，即只要使用特定密钥将“熔丝 (FUSE)”熔断，就无法再使用任何其他密钥对其进行编程。
EFuse 广泛适用于各种量产器件，在本文中我们将为大家演示一个典型情境，即客户希望向第三方供应商提供采用 AES 编程的 FPGA 的情境。
曾经出现过这样的问题，用户以错误方式对错误的 EFuse...
作者：付汉杰，hankf@xilinx.com，文章转载自：博客园
在嵌入式系统里，以太网是一个基本的接口，既用于调试，也用于数据传输。所以在单板调试过程中，以太网是一个基本的任务。如果以太网工作正常，也可以说是一个重要的里程碑。
Xilinx MPSoC支持多个网卡，应用成熟，下面是常见的调试思路。
1. 以太网硬件
以太网的硬件，分为两块，第一是MAC，第二是PHY。当然...
作者：Ken Sloat，DesignLinx Hardware Solutions 公司嵌入式软件工程师
介绍
在 DesignLinx 硬件解决方案公司，我们使用 PetaLinux 构建定制 Linux 镜像，为客户的定制产品提供支持。不得不承认，初一听闻 PetaLinux 时我是心存质疑的。我的职业背景是嵌入式 Linux，曾从事过大量项目，包括纯 Yocto/...
作者：Hello，Panda ，文章转载自：ZYNQ分享客微信公众号
MIPI是移动领域最主流的视频传输接口规范，没有之一，目前应用最广泛的是MIPIDPHY和MIPI CPHY两组协议簇（另外还有MIPI MPHY，属于高速Serdes范畴，应用不那么广泛），其中CSI-2主要用于图像接入（一般是接Sensor），DSI-2主要用于图像输出（一般是输出到显示屏）。
本文主要以CSI...
本文转载自： 网络交换FPGA微信公众号
三端口可编程NIC设备，以其与生俱来的结构优势在各种场景下都可以大显身手，尤其是在网络测量和网络监控领域。在FCCM2020会议上，一篇100G开源的类似于本公众号之前介绍的1G“网络监兵”的研究文章（实验室自研产品介绍：一种多功能的三端口T型转发器）：FFShark: A 100G FPGA Implementation of BPF...
文章转载自：XILINX技术社区微信公众号
Vivado 集成设计环境支持将通用验证方法学 (UVM) 应用于Vivado 仿真器。
Vivado 提供了预编译的 UVM V1.2 库。
请遵循以下步骤创建示例设计测试案例，以便在工程模式下使用 UVM。
本文随附了 1 个简单示例，可供您下载解压使用。
1. 在 Vivado 2019.2 中创建新 RTL 工程...
作者：范龙飞 来源：MYMINIEYE
1、为什么需要调制？
调制就是把要传递的信号“搬运”到规定的频率附近，从技术上说，天线的尺寸和电磁波的波长差不多的时候，才能获得较高的发射效率，假设信号是10MHz,那么波长为30m，这么长的天线显然是不现实的。因此需要把信号调制到较高的频率，减少天线的尺寸，从频谱方面上说，频谱是一个国家的资源，有专门的机构进行管理，...
文章转载自：XILINX技术社区微信公众号
上期我们分享了王伟老师的技术文章解析（上）
本期将会给大家带来下集解析，Ultra96v2petalinux 2019.2软件平台设计与调试和Vitis AI Linux加速平台的介绍。
《含Wifi和DPU功能的Ultra96v2 Vitis AI Linux加速平台的设计与制作》-下
第二部分...
作者：付汉杰，hankf@xilinx.com，文章转载自：博客园
有些应用中，单板没有DDR，OCM又不够存储所有数据和指令。这种情况下，Xilinx提供了参考设计Zynq-7000 AP SoC Boot - Booting and Running Without External Memory，把代码和只读数据放在QSPI Flash中运行程序，这就是execute in place...
作者：安平博，Xilinx高级工程师；来源：AI加速微信公众号
在仿真验证中，SV语言不能很好的描述复杂的计算或者流程关系，使用软件语言（比如C）就比较方便。那么当我们使用C描述了这些关系后，如何在基于SV的仿真环境中使用呢？有两种方式，一种是将C编译为可执行文件，利用系统函数进行调用。另外一种方式利用SV提供的 DPI-C接口。第一种方式并不是严格意义上的SV和C的对接，...
本文转载自： XILINX技术社区微信公众号
来源：开发者投稿 北邮世纪学院 徐知劼
赛灵思鼓励高校相关专业或有兴趣了解FPGA及其各类开发平台与设计工具的同学积极参与开源项目，我们会一如既往地从技术与产品角度给予大力支持。欢迎与我们分享您的开发心得与技术观点。投稿请发送至邮箱 cncrc@xilinx.com ，咨询请至留言板。
1. 初识XILINX...
作者：付汉杰，hankf@xilinx.com，文章转载自：赛灵思中文社区论坛
更改VCU TRD PetaLinux工程的XSA/HDF文件后，编译失败。错误信息类似如下：
Error: build/tmp/work/plnx_zynqmp-xilinx-linux/device-tree/xilinx-v2019.2+gitAUTOINC+a8b39cf536-r0/system...
Zynq UltraScale+ MPSoC 启动时间估算器电子表显示，QSPI 的闪存频率为 13.89MHz。
如何达到该频率？
解决方案
首先，在不加载 QSPI 映像的情况下，在 QSPI 启动模式下引导 ZCU102 电路板，然后读取以下寄存器：
IOPLL_CTRL (CRL_APB) @oxFF5E0020:
FBDIV = 0x32 (50)...
作者：付汉杰，hankf@xilinx.com，文章转载自：赛灵思中文社区论坛
可以使用EGL Pixmap例子测试MPSoC GPU性能。运行EGL Pixmap，要使用fbdev作为egl backend。
在 /project-spec/meta-user/conf/petalinuxbsp.conf里添加下列内容，再编译。
MALI_BACKEND_DEFAULT...
随着现代图像及视频处理技术的不断发展，人们对图像处理提出了新的要求，最近几年，图像的分辨率和扫描频率都有了较大范围的提升，1080P分辨率的视频已经非常流行，2K甚至4K分辨率的图像也在火热发展中。
基于软件的图像处理方法存在着一些局限性，尤其是计算速度和算法效率方面。所以大家很自然的就想到了FPGA作为嵌入式图像应用的平台。许多图像处理本身就是并行计算的，并且FPGA的编程硬件，...
1.案例说明
(1) PL端接入CameraLink相机，通过Base模式采集图像（1280*1024），然后通过VDMA缓存到PS端DDR。
(2) 使用AXI4-Stream Switch IP核将图像复分成两路，一路用于边缘检测处理（Sobel算法），另一路直接回显。
(3) 利用Video Mixer IP核将图像叠加，通过HDMI输出原始图像或者算法处理后的图像...
作者：安平博，Xilinx高级工程师；来源：AI加速微信公众号
引言
随着人工智能和5G的兴起，数据处理对芯片的算力和带宽要求更高。为了布局未来，助力人工智能和5G，赛灵思也推出了自己的FPGA加速芯片-ACAP。ACAP是一款基于7nm工艺，集成了通用处理器（PS），FPGA（PL），math engine以及network-on-chip的革命性芯片。特别是新增的ME结构，...
本文转载自： PYNQ开源社区微信公众号
注：如您有RISC-V教学支持需求(课件，平台，师资培训等)，欢迎联系 xup_china@xilinx.com
Overlay 简介
RISC-V-On-PYNQ Overlay实现了在PYNQ-Z2板上的RISC-V处理器及工具链集成，并提供了完整的RISC-V源码与设计流程，得益于PYNQ软件框架，其支持在Jupyter...
本文转载自： XILINX技术社区微信公众号
本篇是由来自日本 PALTEK 公司的泷泽雅治 (Masaharu Takizawa) 撰写的特邀博文。
本篇博文涵盖了配置设备树以将外设和第三方应用详细信息添加到 PetaLinux 工程中的基本流程。
在某些情况下，设备树无法生成相关外设所需的所有必需信息，例如，以太网 PHY 信息。
在此类情况下，...
本文转载自： PYNQ开源社区
成为公民科学家不是梦！闲置的计算资源不仅用于精确地建模重要蛋白质的结构，还用于设计新蛋白质，让我们一起参与抗击COVID-19！
还记得Foldit这个蛋白质折叠电子游戏吗，通过游戏的方式让成千上万的游戏玩家参与到蛋白质折叠的设计中，分析甚至创造出新的蛋白质。这款游戏2008年就已问世，研发这款游戏的三位主角分别是华盛顿大学的计算机专家Zoran...
作者：范龙飞 来源：MYMINIEYE微信公众号
FPGA中DSP资源是宝贵的且有限，我们在计算大位宽的指数、复数乘法、累加、累乘等运算时都会用到DSP资源，如果我们不了解底层的DSP特性，很多设计可能都无法进行。逻辑综合往往是不可控的，为了能够充分利用DSP资源，我们需要对DSP48E1有所了解。
1.DSP48E1介绍
DSP48E1是7系列的最小计算单元，...
作者：付汉杰，hankf@xilinx.com，文章转载自：赛灵思中文社区论坛
PetaLinux以前的版本中，在project-spec/meta-user/conf/petalinuxbsp.conf里添加MALI_BACKEND_DEFAULT = "wayland"”，在编译时选择图形backend。
在PetaLinux 2019.1里，默认集成多个图形backend。...
作者：付汉杰，hankf@xilinx.com，文章转载自：赛灵思中文社区论坛
1. 问题
在Ubuntu 16.04安装Vitis 2019.2失败，收到错误信息。
Ubuntu 16.04安装Vivado 2019.2失败错误信息
2. 硬盘大小
检查硬盘大小，系统盘还有168G，安装目录/opt/Xilinx还有587G，都有足够大小。
$ df -h...
作者：咸鱼FPGA 文章来源：FPGA开源工作室
心跳包就是在客户端和服务器间定时通知对方自己状态的一个自己定义的命令字，按照一定的时间间隔发送，类似于心跳，所以叫做心跳包。心跳包在GPRS通信和CDMA通信的应用方面使用非常广泛。数据网关会定时清理没有数据的路由，心跳包通常设定在30-40秒之间。所谓的心跳包就是客户端定时发送简单的信息给服务器端告诉它我还在而已。...
本答复记录涵盖在 HyperLynx 中创建 IBIS-AMI 仿真测试平台的步骤。
以 UltraScale+ GTY IBIS-AMI 模型为例。
本教程使用 HyperLynx VX.2.4。
解决方案
1) 请从专区下载最新的 IBIS-AMI 模型
UltraScale+ GTH/GTY/GTR：https://china.xilinx.com/member/...
机器视觉系统中，镜头相当于人的眼睛，其主要作用是将目标的光学图像聚焦在图像传感器（相机）的光敏面阵上。视觉系统处理的所有图像信息均通过镜头得到，镜头的质量直接影响到视觉系统的整体性能。下面对机器视觉工业镜头的相关专业术语做以详解。
一、失真
可分为枕形失真和桶形失真，如下图示：
二、电视失真
实际边长的歪曲形状与理想的形状的百分比算出的值。
三、...
1. Author
作者：付汉杰，hankf@xilinx.com，文章转载自：赛灵思中文社区论坛
2. 概述
Xilinx提供了完整的V4L2的驱动程序，Xilinx V4L2 driver。处于最顶层的驱动程序是V4L2框架的视频管道（Video pipeline）驱动程序，也叫桥驱动程序（bridge driver），主要代码在文件xilinx-vipp.c中。在V4L2框架中，...
作者：许赛飞 ，来源：MYMINIEYE微信公众号
对于FPGA开发而言，仿真是开发流程中必不可少的一步，也是非常重要的一步，仿真是将RTL代码模拟运行，得到module中信号波形，再进行功能分析的过程。强大的功能与速度兼具的modelsim仿真就是你开发过程的最合适的选择了，下面我以简单的24进制计数器带各位熟悉modelsim仿真流程及波形。
一、新建工作库Library...
作者：Clive "Max" Maxfield，Digi-Key北美编辑
文章转载自：Digikey官网
现场可编程门阵列 (FPGA) 具有诸多特性，无论是单独使用，抑或采用多样化架构，皆可作为宝贵的计算资产；但是许多设计人员并不熟悉 FPGA，亦不清楚如何将这类器件整合到设计中。解决办法之一是深入研究主要供应商提供的 FPGA 架构及相关工具；本文则从 Xilinx...
有两种方法可以将 Alveo 数据中心加速卡上 Quad SPI 部件的内容还原为出厂映像。
本答复提供一般性说明，以及带逐步说明的文档的参考。
Alveo 数据中心加速卡通过 Xilinx Runtime 环境重置：
选项 1:
所需工具：Xilinx Runtime 2019.1 或更新版本，安装在支持 Alveo 数据中心加速卡的系统上。
如果...
作者：付汉杰，hankf@xilinx.com，文章转载自：赛灵思中文社区论坛
有些应用中，单板没有DDR，OCM又不够存储所有数据和指令。这种情况下，Xilinx提供了参考设计Zynq-7000 AP SoC Boot - Booting and Running Without External Memory，把代码和只读数据放在QSPI Flash中运行程序，这就是execute in...
作者：范龙飞 来源：MYMINIEYE微信公众号
1.数字下变频介绍
数字下变频是一种广泛应用于数字无线电接收机的数字信号处理技术，其主要目的是经过数字混频将A/D转换输出的中频信号搬移至基带，然后通过滤波，抽取完成信道提取的任务，如下所示：
主要的电路模块由四部分组成：数控震荡、数字混频、数字滤波、采样抽取。
2.matlab结果
(1...
作者：碎碎思 文章来源：OpenFPGA微信公众号
GMII、SGMII和SerDes的区别和联系？
GMII和SGMII区别，上一篇已经介绍了，这一篇重点介绍SGMII和SerDes区别。
GMII和SGMII
SGMII接口
SGMII和SerDes
终于到了今天的猪脚-SerDes，为什么拿SGMII和SerDes进行对比，主要原因是，...
作者：付汉杰，hankf@xilinx.com，文章转载自：赛灵思中文社区论坛
Xilinx的SoC在业界应用非常广泛。对应的开发工具SDK也很成熟。在SDK里，每一个baremetal工程，对应一个BSP工程，它包含一些Xilinx提供的公共模块，比如硬件的驱动、freertos、LWIP等。在BSP工程的右键菜单中，选择BSP setting，可以配置BSP工程包含的的公共模块...
作者：付汉杰，hankf@xilinx.com，文章转载自：赛灵思中文社区论坛
某些应用程序小，可以全部放在Zynq-7000的256KB OCM上运行。这时，修改FSBL，可以把APP和FSBL编译成一个可执行文件，FSBL初始化硬件后，就直接运行应用程序。
这种情况下，单板没有DDR。
1. DDR
缺省的FSBL，...
本设计咨询主要面向 7 系列和 Virtex-6 FPGA，其中包含赛灵思针对 2020 年 4 月 15 日发布的一篇有关破解比特流加密的文章的回应，详情将于“USENIX Security 2020”大会上发表。
如需了解如何注册接收新设计咨询通知的更多信息，请参阅 （赛灵思答复记录 18683）。
解决方案
7 系列 FPGA
作者成功利用了 AES-CBC...
作者：品客， 文章转载自：PYNQ开源社区
图像处理算法在各种场景中都有广泛应用，借助于FPGA并行计算的优势可以将算法性能有效提升，但为了提升系统整体性能，仅仅提升某一部分的性能是不够的，一个好的方法是在FPGA内实现全部视频输入输出接口和图像算法的完整通路。本Overlay的视频输入来自OV5640摄像头，包含多个可任意切换的图像处理算法，并包含了一个HDMI输出接口显示处理结果...
作者：付汉杰，hankf@xilinx.com，文章转载自：赛灵思中文社区论坛
PetaLinux环境下，也可以使用Yocto/openembedded的bitbake。Xilinx ug1144有详细说明。
为了方便，我编写了以下脚本，导入bitbake需要的环境。将下列脚本保存为sh文件，使用source导入，之后就能使用bitbake。...
作者：Praveen Venugopal
注意：本文转载自赛灵思中文社区论坛，所有内容皆来源于Xilinx工程师，如需转载，请写明出处作者及赛灵思论坛链接并发邮件至cncrc@xilinx.com，未经Xilinx及著作权人许可，禁止用作商业用途
何谓 I2C？
在本文中，您将了解有关内部集成电路总线（I2C 或 IIC）的基础知识以及将此协议总线应用于短距离通信的方法。...
作者：付汉杰，hankf@xilinx.com，文章转载自：赛灵思中文社区论坛
1. 介绍
Vitis是Xilinx新推出的统一软件平台，可实现在 Xilinx 所有芯片（包括 FPGA、SoC 和 Versal ACAP）上开发嵌入式软件和加速应用。Xilinx主要宣传Vitis可以为异构平台的应用实现加速。其实，Vitis也能完美的支持嵌入式软件开发。...
作者：付汉杰，hankf@xilinx.com，文章转载自：赛灵思中文社区论坛
Xilinx SDK Flash Programmer 支持Flash烧写。但是市场上Flash型号众多。不是所有的Flash型号，Xilinx SDK Flash Programmer都支持。如果遇到不支持的Flash型号，可以自己通过U-Boot实现一个简易的Flash Programmer。...
作者：范龙飞，来源：MYMINIEYE微信公众号
在Xinlinx的ZYNQ中，拥有ARM+FPGA这种架构，每款产品均带有双精度浮点的双核ARMCortex-A9MPCore处理系统，ARM(PS端)具有比较强的事务管理功能，可以用来跑界面以及应用程序等，其优势主要体现在控制方面，里面整合了很多现成的硬件资源供编程调用。FPGA(PL端)灵活性强，拥有更大的并行度和计算能力，...
文章转载自： XILINX技术社区
引言
在某些情况下，通过嗅探 AXI 接口来分析其中正在发生的传输事务是很有用的。在本文中，我将为大家演示如何创建基本 AXI4-Lite Sniffer IP 以对特定地址上正在发生的读写传输事务进行计数。
首先，编写 HDL (Verilog) 代码，然后将其封装为 IP，最后将此 IP 添加到 IP IntegratorBlock...
作者：付汉杰，hankf@xilinx.com，文章转载自：赛灵思中文社区论坛
Xilinx文件基本都放在国外的服务器上。如果直接使用浏览器下载，在国内下载，速度一般比较慢。如果超过时间没有下载完，连接还会失效，导致反复下载也不能成功，成功率比较低。
为了提升Xilinx文件下载速度和可靠性的办法，建议使用专门的下载工具。先在xilinx下载网站登录，使用浏览器下载指定文件，...
作者：许赛飞 ，文章来源：MYMINIEYE微信公众号
CLB是指可编程逻辑功能块（Configurable Logic Blocks）,顾名思义就是可编程的数字逻辑电路。CLB是FPGA内的三个基本逻辑单元。CLB的实际数量和特性会依器件的不同而不同，但是每个CLB都可配置，在Xilinx公司的FPGA器件中，CLB由2个...
本文转载自： PYNQ开源社区微信公众号
近来卷积神经网络（CNN）的研究十分热门。CNN发展的一个瓶颈就是它需要非常庞大的运算量，在实时性上有一定问题。而FPGA具有灵活、可配置和适合高并行度计算的优点，十分适合部署CNN。
快速开始
环境需求PYNQ v2.4，Python 3.6.5。
需要安装caffe和Lasagne这两个计算平台。...