基于FPGA的数字信号处理(3)--如何确定Verilog表达式的符号
judy 在 周二, 09/10/2024 - 14:58 提交
尽管signed语法的使用能带来很多便利,但同时也给表达式的符号确定带来了更多的不确定性。比如一个有符号数和一个无符号数的加法/乘法结果是有符号数还是无符号数?
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