AMD Versal™ Adaptive SoC CPM PCIE PIO EP 设计 CED 示例
judy 在 周五, 05/10/2024 - 16:15 提交
本文可让开发者们看懂 AMD Vivado™ Design Tool 2023.2 中的“AMD Versal™ Adaptive SoC CPM PCIE PIO EP 设计”CED 示例。
每日头条
AMD 以太网设计示例
judy 在 周五, 05/10/2024 - 09:55 提交
AMD 提供了支持不同速度的多种以太网 IP。此外，还提供了设计示例供用户用作参考。请参阅以下以太网设计示例列表。
基于VDMA的远程图像采集系统参考设计
judy 在 周四, 05/09/2024 - 16:59 提交
本参考设计基于ZYNQ开发板， 使用VDMA做原始图像采集系统，在petalinux下做服务器，通过Socket发送图像至Windows或者Linux上位机。
劳特巴赫利用 Zynq 突破嵌入式系统设计极限
judy 在 周四, 05/09/2024 - 09:55 提交
劳特巴赫的 PowerDebug 模块设计选用了 AMD Zynq™ UltraScale+™ MPSoC。该器件以优化的异构处理引擎组合形式提供了出色的处理、I/O 和内存带宽
在 Windows 10 上创建并运行 AMD Vitis™ 视觉库示例
judy 在 周三, 05/08/2024 - 10:08 提交
本篇文章将演示创建一个使用 AMD Vitis™ 视觉库的 Vitis HLS 组件的全过程。此处使用的是 Vitis Unified IDE。
DPU Fingerprint详解
judy 在 周二, 05/07/2024 - 14:25 提交
本文将会详细介绍关于DPU Fingerprint的相关内容，并提供此类校验失败问题的检查手段和解决方案。
如何在Vivado中使用多个仿真集？
judy 在 周二, 04/30/2024 - 09:58 提交
Vivado 具有一个功能特性，能够将这些文件便利地排列组合为多个可轻松访问的不同仿真集。本文描述了如何在 Vivado 中使用多个仿真集。
如何在RTL代码中利用外部文件初始化RAM内容
judy 在 周一, 04/29/2024 - 16:31 提交
本文主要讨论一下如何在外部数据文件中指定RAM 初始内容。
AMD Versal AI Edge 自适应计算加速平台之体验ARM，裸机输出(7)
judy 在 周日, 04/28/2024 - 10:33 提交
本章使用一个简单的串口打印来体验一下Vivado Vitis和PS端的特性
产品升级！亚科鸿禹推出更大规模验证容量的融合Emulator--HyperSemu2.0！
judy 在 周五, 04/26/2024 - 14:28 提交
HyperSemu2.0为用户提供近2亿门验证容量和稳定高效的系统运行，满足更前沿数字设计更多维验证场景的应用需求。