MMCM/PLL的phase shift mode对STA的影响
judy 在 周一, 04/08/2024 - 15:01 提交在 AMD FPGA 中,当 MMCM 或 PLL 原语的输出时钟属性 CLKOUT*_PHASE 非零时,通常会引入时钟相移。
在 AMD FPGA 中,当 MMCM 或 PLL 原语的输出时钟属性 CLKOUT*_PHASE 非零时,通常会引入时钟相移。
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