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AMD推出采用第二代 Versal AI Edge 系列的自动驾驶域控制器
Lattice Nexus 2平台:低功耗、高性能、小尺寸FPGA再创新高
思尔芯第八代原型验证S8-100全系已获客户部署,双倍容量加速创新
Python实现TFTP
一、TFTP协议简单介绍 1、定义 TFTP(Trivial File Transfer Protocol):简单文件传输协议)。 TFTP是TCP/IP协议族中的一个用来在客户端与服务器之间进行简单文件传输的协议,传输不复杂、开销不大的文件。端口号固定为69。 TFTP是一个传输文件的简单协议,它基于UDP协议而实现。 2、特点 简单、占用资源少、基于UDP实现、端口号为69、...
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2018-09-05 |
python
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TFTP
CNN在ZYNQ上的实现
ZYNQ简介 ZYNQ系列是Xilinx推出的高端嵌入式SoC,其在片上集成了ARM处理器和FPGA。ZYNQ与传统的嵌入式CPU相比,具有强大的并行处理能力。开发人员利用FPGA强大的并行处理能力,不仅可以解决多种不同信号处理应用中的大量数据处理问题,而且还能通过加入更多外设来扩展处理系统的功能。ZYNQ通过引入最新的高速AXI-4总线,可轻松实现外设的扩展与高速互访。 ZYNQ...
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2018-09-05 |
CNN
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Zynq
告别选择困难症——区分FPGA与CPLD
如何区分CPLD或FPGA和哪一个更适合自己?这是一个老生常谈的问题,尤其是学生和初学者。如果您也在这个问题上很迷茫,那么就请听小编为您区分FPGA与CPLD。 CPLD 我们先来看看CPLD,在此以Xilinx CoolRunner-II为例。下图是Xilinx CoolRunner-II的架构图。 现在小编为您解释一下上图的内容。 1.该CPLD具有从“功能块1”到“功能块n”...
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2018-09-04 |
CPLD
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FPGA
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今日头条
基于Vivado HLS的帧差图像实现
作者:晨,来源:FPGA开源工作室 1. 帧差法原理 帧差法的实现非常简单: 如图可见,由目标运动引起的运动变化区域包括运动目标在前后两帧中的共同位置(图中黑色区域)、在当前帧中新显露出的背景区域和新覆盖的背景区域三部分。 数学原理: 2.vivado HLS实现 Vivado HSL是xilinx公司推出的高层次综合工具,使用C/C++就能实现传统的verilog语言进行的开发,...
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2018-09-04 |
Vivado HLS
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帧差法
PCIe学习(三)——PCIe DMA关键模块分析之二
简介 这是学习PCIe DMA传输的第二篇博客,在前一篇中叙述了PCIe DMA传输的部分基础知识,并且较为详细的分析了接收引擎的各个状态,这里接着分析第二个关键模块:发送引擎(BMD_64_TX_ENGINE.v)。 软件:VIVADO2017.4 第一步:模块功能分析 在分析发送引擎的具体操作之前,需要多这个模块实现的功能进行简单的分析。...
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2018-09-04 |
PCIe
学会System Generator(15)——三种数控振荡器设计方法
本文是该系列的第15篇。数字控制振荡器(NCO)是FPGA中常用的一个模块,在《FPGA数字信号处理系列》第一篇就对其做了相关介绍。System Generator中的block大致可以分为两类:高层次封装(面向系统级,如第2篇设计中用到的Digital FIR Filter)和低层次封装(面向底层,与FPGA资源的联系更直接)。 本文将采用IIR滤波器、DDS、DDS Compile...
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2018-09-04 |
System Generator
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数字控制振荡器
【视频】高带宽内存
在需要高带宽的应用中使用高带宽内存(HBM)。
2018-09-03 |
高带宽内存
Python的22个编程技巧,Pick一下?
1. 原地交换两个数字 Python 提供了一个直观的在一行代码中赋值与交换(变量值)的方法,请参见下面的示例: x,y= 10,20print(x,y)x,y= y,xprint(x,y)#1 (10, 20)#2 (20, 10) 赋值的右侧形成了一个新的元组,左侧立即解析(unpack)那个(未被引用的)元组到变量 和 。 一旦赋值完成,新的元组变成了未被引用状态并且被标记为可被垃圾回收,...
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2018-09-03 |
python
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编程
FPGA驱动VGA显示静态图片
一 、前言 本文设计思想采用明德扬至简设计法。VGA是最常见的视频显示接口,时序也较为简单。本文从利用显示屏通过VGA方式显示测试图案及静态图片着手带大家接触图像显示应用,算是为后续VGA显示摄像头采集图像以及HDMI高清数字显示方式打个基础。 二、VGA显示原理 关于VGA的详细解释可查看参考文献1,这里主要讲解下根据VGA的分辨率计算时钟频率的方式。以本文使用到的1024*768@...
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2018-09-03 |
VGA
系统和芯片架构正在走向异构世界
作者:Jeffrey Burt 有时候,如果你在业务上持之以恒,生意就会找上门来。 数十年来,Xilinx一直是FPGA的领导者,目前仍占有60%的市场份额。英特尔近三年前以167亿美元收购了Xilinx的竞争对手Altera,占据了其余市场的大部分份额。尽管Xilinx多年来一直保持稳定增长,2018财年收入达到创纪录的25.4亿美元,较上年增长8%,...
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2018-09-03 |
ACAP
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异构计算
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机器学习
数字设计FPGA应用学习笔记
第一章 FPGA基础及电路设计 FPGA基础及电路设计包含两个方面的内容,一个是FPGA基础及7系列FPGA基本原理,另外就是FPGA电路设计,FPG广泛应用于军事、医疗、工业、通信等领域,下面是两款实验板: FPGA基础及7系列FPGA基本原理
2018-09-03 |
FPGA
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数字设计
使用 MATLAB 和 Simulink 实现你的机器人创意
机器人技术研究人员和工程师可以使用 MATLAB 和 Simulink 设计和优化算法,为真实系统建立模型,并自动生成代码——所有过程均在一个软件环境下完成。 MATLAB 和 Simulink 可以实现: 用您开发的算法连接并控制您的机器人 开发与硬件无关的算法并连接到机器人操作系统(ROS) 连接一系列传感器和执行机构,以便发送控制信号或分析多种类型的数据 为嵌入式目标(如微控制器、FPGA...
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2018-08-31 |
Matlab
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Simulink
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机器人
从Xilinx Kintex-7认识FPGA
作者:lee神,FPGA开源工作室 1. xilinx FPGA简介 FPGA(Field-Programmable Gate Array),即现场可编程门阵列,它是在PAL、GAL、CPLD等可编程器件的基础上进一步发展的产物。它是作为专用集成电路(ASIC)领域中的一种半定制电路而出现的,既解决了定制电路的不足,又克服了原有可编程器件门电路数有限的缺点。
2018-08-31 |
FPGA
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Xilinx
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Kintex-7
【视频】UltraScale 架构收发器
回顾 UltraScale 架构中的收发器增强特性。
2018-08-31 |
收发器
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UltraScale
学会System Generator(14)——不同溢出与量化方式的对比
本文是该系列的第14篇。第5篇中在介绍Gateway In block时谈到了System Generator中的数据类型,及不同的量化和溢出方式。本文将以两个简单的设计实例,更直观地说明不同的量化和溢出方式有什么区别。 溢出(Overflow)方式对比 从Simulink向System Generator的数据转换过程中可能会出现溢出(Simulink中的值超出了所设置数据格式能够表示的范围...
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2018-08-31 |
System Generator
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