使用vivado和Modelsim进行仿真
judy 在 周四, 09/21/2023 - 15:16 提交
本文主要学习了两种仿真方法，并且分别对工程进行仿真。
Vivado 是赛灵思（Xilinx）公司推出的一款综合性的设计工具套件，用于 FPGA（现场可编程门阵列）和 SoC（系统级芯片）的设计、开发和验证。它提供了一系列功能强大的工具，帮助工程师在各种应用领域中实现高性能、低功耗的硬件设计。
Vivado
AMD FPGA vitis-vivado软件快速入门课程
judy 在 周二, 09/19/2023 - 10:09 提交
本文演示如何快速上手AMD-FPGA开发工具软件vitis-vivado
Vivado如何清理工程，并避免缺失必要的文件？
judy 在 周一, 09/18/2023 - 09:15 提交
本文将介绍如何清理Vivado工程，并避免缺失必要的文件。
节省编译时间系列 5：为多个 Vivado 工程复用远程 IP 高速缓存
judy 在 周五, 09/15/2023 - 10:50 提交
在设计周期中，您可保留多个版本的工程，这些工程使用相同的 IP 和相同的配置
Vivado布线和生成bit参数设置
judy 在 周四, 09/14/2023 - 09:29 提交
本文主要介绍Vivado布线参数设置
Vivado增量编译：加速FPGA设计实现的利器
judy 在 周二, 09/12/2023 - 10:25 提交
本文将介绍Vivado增量编译的基本概念、优点、使用方法以及注意事项
解锁Vivado综合技巧，这份HDL XDC属性设置清单让你事半功倍！（一）
judy 在 周三, 09/06/2023 - 09:34 提交
本文将介绍Vivado综合工具支持的常用属性设置
Vivado设计资源优化 ，查看各子模块资源占用的方法大全
judy 在 周一, 09/04/2023 - 09:13 提交
本文介绍Vivado中如何进行FPGA设计资源优化以及查看各子模块资源占用的方法
Vivado约束添加方法：一文全面解析IO和时序约束
judy 在 周五, 09/01/2023 - 09:07 提交
本文将介绍vivado中常见的设置约束方法
Vivado RTC实时时钟系统设计
judy 在 周一, 08/28/2023 - 10:19 提交
我们一起学习一下RTC的驱动